インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 17.1 Stratix® 10 の LDPC FPGA IP の問題により、Modelsim の WiMedia 1.5 標準およびエンコーダー・モードで構成された IP によって生成された IP によって生成されたシミュレーション・デザイン例をコンパイルする際に、上記のエラーが表示されることがあります。
この問題を回避するには、msim_setup.tcl 内の次の行をコメント アウトします。
1. eval vlog -sv $USER_DEFINED_VERILOG_COMPILE_OPTIONS $USER_DEFINED_COMPILE_OPTIONS "$QSYS_SIMDIR/../src/altera_ldpc_pkg.sv" -作業作業
2. eval vlog -sv $USER_DEFINED_VERILOG_COMPILE_OPTIONS $USER_DEFINED_COMPILE_OPTIONS "$QSYS_SIMDIR/../src/altera_ldpc_wimedia_enc.sv" - 作業作業