インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションの問題により、Avalon®-ST クレジット・パイプライン IP を含むデザインをコンパイルすると、このエラーが表示される場合があります。このエラーは、空の使用、チャネルの使用、または使用エラーが無効で、関連付けられているポート幅が 1 に設定されていない場合に発生します。この問題は、VHDL で生成されたプラットフォーム・デザイナー・システムにのみ影響します。
この問題を回避するには、Verilog HDL でプラットフォーム・デザイナー・システムを生成するか、未使用のポート幅を 1 に設定してください。
この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションのバージョン 20.2 以降で修正されています。