記事 ID: 000080529 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

Arria V ピンアウト表: 既知の問題

環境

BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細 問題 63759:2012年7月以前のArria V デバイスすべてのピン配列表

ピンアウト・ファイルでは、コンフィグレーション・モードがアクティブモードの場合、コンフィグレーション後に DCLK をユーザー I/O として使用できるとは表示されません。 DCLK は、コンフィグレーション・モードがアクティブモードの場合、コンフィグレーション後に通常の I/O ピンとして使用できます。

関連製品

本記事の適用対象: 4 製品

Arria® V SX SoC FPGA
Arria® V ST SoC FPGA
Arria® V GT FPGA
Arria® V GX FPGA

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