記事 ID: 000080322 コンテンツタイプ: トラブルシューティング 最終改訂日: 2014/05/07

ワードアライナーが手動アライメントモードで、PMA-PCS インターフェイスが 20 ビット幅の場合、Arria® V GX デバイスは Rate Match FIFO オプションをサポートしますか?

環境

  • インテル® Quartus® II サブスクリプション・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    はい。Arria® V GX デバイスは、ワードアライナーが手動アライメントモードで、PMA-PCS インターフェイスが 20 ビット幅の場合、Rate Match FIFO オプションをサポートします。

    Arria® V デバイス・ハンドブック (PDF) のトランシーバー・カスタム・コンフィグレーションの図 5-6 の誤りにより、レートマッチ FIFO は無効として表示されます。

    解決方法

    この問題は、Arria® V デバイス・ハンドブック (2014年9月30日) のトランシーバー・カスタマー・コンフィグレーションから修正されました。

    関連製品

    本記事の適用対象: 2 製品

    Arria® V GX FPGA
    Arria® V SX SoC FPGA

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