記事 ID: 000080079 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/29

Arria 10 DDR4 モード・レジスター 4 (MR4) のプリアンブルビットの書き込み / 読み込みが正しく設定されていないのはなぜですか?

環境

  • インテル® Quartus® II サブスクリプション・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細 Quartus® II ソフトウェア・バージョン 13.1 Arria 10 エディションで、DDR4 MR4 書き込み / 読み取りプリアンブル・ビットが誤って設定されている既知の問題があります。
    解決方法 この問題は、インテル® Quartus® II ソフトウェア・バージョン 14.0 Arria 10 エディションで修正されています。

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    本記事の適用対象: 3 製品

    インテル® Arria® 10 GX FPGA
    インテル® Arria® 10 GT FPGA
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