記事 ID: 000079374 コンテンツタイプ: エラーメッセージ 最終改訂日: 2021/08/28

警告 (272007): device_family Cyclone IV GX のクリアボックス・デザイン・ファイル altera_tse_alt4gxb_gige_wo_rmfifo.v の再生成中にエラーが発生しました。元のデザインが正しく動作しない可能性があります。

環境

  • インテル® Quartus® II サブスクリプション・エディション
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    Qsys バージョン 11.1 のバグにより、Quartus® II ソフトウェアは Qsys システムの警告 (272007) を報告する場合があります。 Cyclone® IV GX デバイス用トリプルスピード・イーサネット MegaCore ファンクションを含みます。

    解決方法

    1. テキスト・エディターで生成された QIP ファイル Qsys を開きます。QIP ファイルは合成ディレクトリーにあります。

    2. 次の 6 行を削除

    set_global_assignment -library"lib_[instans name]" -name VERILOG_FILE [file join $::quartus(qip_path) サブモジュール/altera_tse_alt2gxb_arriagx.v]
    set_global_assignment -library"lib_[instans name]" -name VERILOG_FILE [file join $::quartus(qip_path) サブモジュール/altera_tse_alt2gxb_basic.v]
    set_global_assignment -library"lib_[instans name]" -name VERILOG_FILE [file join $::quartus(qip_path) submodules/altera_tse_alt2gxb_gige.v]
    set_global_assignment -library"lib_[instans name]" -name VERILOG_FILE [file join $::quartus(qip_path) submodules/altera_tse_alt2gxb_gige_wo_rmfifo.v]
    set_global_assignment -library"lib_[instans name]" -name VERILOG_FILE [file join $::quartus(qip_path) サブモジュール/altera_tse_alt4gxb_gige.v]
    set_global_assignment -library"lib_[instans name]" -name VERILOG_FILE [file join $::quartus(qip_path) サブモジュール/altera_tse_alt4gxb_gige_wo_rmfifo.v]

    3. QIP ファイルを保存して閉じます。

    4. デザインを再度コンパイルする

    この問題は、インテル® Quartus® II ソフトウェア・バージョン 12.0 から解決されています。

    関連製品

    本記事の適用対象: 1 製品

    Cyclone® IV GX FPGA

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