記事 ID: 000079271 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/29

SerialLite III ストリーミング MegaCore ファンクション・ユーザーガイドで 2 つの信号を除外

環境

    インテル® Quartus® II サブスクリプション・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT

クリティカルな問題

詳細

SerialLite III ストリーミング MegaCore ファンクション・ユーザーガイド v14.0 は、以下の 2 つの信号の言及を誤って省略しました。

reconfig_to_xcvr

  • 入力
  • 幅: ソース IP コアおよびデュプレックス IP コア: 140 x N。シンク IP コア: 70 x N。
  • クロックドメイン: phy_mgmt_clk
  • 説明: ハード・トランシーバー用ダイナミック・リコンフィグレーション入力 V GX およびStratix V デバイスArria。N はレーンの数です。

reconfig_from_xcvr

  • 出力
  • 幅: ソース IP コアおよびデュプレックス IP コア: N x 92。シンク IP コア: 46 x N。
  • クロックドメイン: phy_mgmt_clk
  • 説明: ハード・トランシーバー用ダイナミック・リコンフィグレーション出力 V GX およびStratix V デバイスArria。N はレーンの数です。
解決方法

この問題を回避する方法はありません。SerialLite III ストリーミングの場合 IP コアのバリエーションは、Arria V GX デバイスまたはStratix V デバイスを対象とし、 この 2 つの信号をデザインに接続する必要があります。

この問題は、SerialLite のバージョン 14.0 Arria 10 エディションで修正されています。 III ストリーミング MegaCore ファンクション・ユーザーガイド

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インテル® プログラマブル・デバイス

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