記事 ID: 000078481 コンテンツタイプ: トラブルシューティング 最終改訂日: 2014/08/22

Stratix® V、Arria® V、または Cyclone® V デバイスをターゲットにする場合、リソース・プロパティー・エディターまたはチッププランナーを使用してフラクショナル PLL (fPLL) パラメーターを変更できないのはなぜですか?

環境

  • Quartus® II Software
  • Arria® V Transceiver PLL Intel® FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    Stratix® V、Arria® V、または Cyclone® V デバイスでデザインする場合、Quartus® II ソフトウェアのリソース・プロパティー・エディターまたはチッププランナーを使用して fPLL のパラメーターを編集することはできません。

    解決方法

    PLL リコンフィグレーション機能を使用して、fPLL パラメーターを動的にアップデートします。

    詳細については、 AN661: Altera PLL および Altera PLL リコンフィグレーション・メガファンクションによるフラクショナル PLL リコンフィグレーションの実装 (PDF) を参照してください。

    関連製品

    本記事の適用対象: 11 製品

    Cyclone® V GT FPGA
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