記事 ID: 000077329 コンテンツタイプ: トラブルシューティング 最終改訂日: 2019/10/15

Stratix®10 L または H タイルのデバイスが、接続されていないトランシーバー・チャネル (チップと光モジュール間のインターフェイスなど) を使用している場合、パフォーマンスは低下しますか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    L タイル H タイル・トランシーバー・ネイティブ PHY インテル® Stratix® 10 FPGA
BUILT IN - ARTICLE INTRO SECOND COMPONENT

クリティカルな問題

詳細

いいえ、トランシーバー・チャネルがアナログ・リセット状態に保たれない限ります。

解決方法

この主題に対する解決策はありません。

関連製品

本記事の適用対象: 4 製品

インテル® Stratix® 10 TX FPGA
インテル® Stratix® 10 SX SoC FPGA
インテル® Stratix® 10 GX FPGA
インテル® Stratix® 10 MX FPGA

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