インテル® Quartus®® II ソフトウェア・バージョン 6.1 および 7.0 のStratix・®・ファミリー・デザイン (StratixおよびStratix GX) では、SignalTap® II: ポスト・フィッティング・フィルターを使用しても、高速 PLL 出力クロックネットは表示されません。 高速 PLL クロック出力を SignalTap II ロジック・アナライザーの取得クロックとして使用するには、使用するポストフィット・クロック・ネット名を入力します。このネット名は、テクノロジー・マップ・ビューアーで確認できます。
この問題は、Quartus® II ソフトウェア・バージョン 7.1 から修正されています。