記事 ID: 000076878 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

Interlaken のデザイン例を使用すると、シミュレーションが失敗するのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • Interlaken (第 2 世代) インテル® FPGA IP
  • Interlaken
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    Interlaken IP Core (第 2 世代) の問題により 、modelsim または ncsim シミュレーション環境を使用すると 、rx_digitalresetとreset_stat が切り替え続けます。その結果、シミュレーション・システムはロックステータスを入力することも、正常に終了することもできません。

    解決方法

    この問題は VCS シミュレーション環境を使用する場合には存在しません。

    この問題は、インテル® Quartus® Prime ソフトウェアのバージョン 17.1 以降修正されています。

    関連製品

    本記事の適用対象: 1 製品

    インテル® Stratix® 10 FPGA & SoC FPGA

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