記事 ID: 000076853 コンテンツタイプ: トラブルシューティング 最終改訂日: 2019/03/15

インテル® Arria® 10 外部メモリー・インターフェイス (EMIF) が MMR スレーブ・ポートにアクセスできないのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    キャリブレーション段階での MMR 抵抗への EMIF IP 内部アクセスにより、この読み取り有効なアサートは MMR スレーブポートから確認できます。この動作は、ユーザーが Avalon MM クロック・クロッシング・ブリッジを介して MMR スレーブ・ポートと Avalon MM マスターを接続すると、アクセスをハングアップします。

     

     

     

    解決方法

      

    関連製品

    本記事の適用対象: 1 製品

    インテル® Arria® 10 FPGA & SoC FPGA

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