記事 ID: 000076852 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

PHYLite IP パラメーター・エディターで「コア PLL リファレンス・クロック接続を使用」パラメーターが利用できないのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    パラレル・インターフェイスの PHY Lite インテル® Stratix® 10 FPGA
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

Quartus® Prime ソフトウェア・バージョン 17.0 以降、PHYLite IP はコア PLL リファレンス・クロック接続をサポートしません。PHYLite PLL リファレンス・クロックは、専用のリファレンス・クロック・ピンに接続されている必要があります。

関連製品

本記事の適用対象: 1 製品

インテル® Arria® 10 FPGA & SoC FPGA

1

ご質問はこちらへ

サポートに問い合わせる

免責事項

1

本サイトでのすべてのコンテンツの投稿および使用には、Intel.com の利用規約が適用されます。

このページのコンテンツは、元の英語のコンテンツを人力翻訳および機械翻訳したものが混在しています。このコンテンツはお客様の便宜と一般的な情報のみを目的として提供されており、情報の正確さと完全性を保証するものではありません。このページの英語版と翻訳の間に矛盾がある場合は、英語版に準拠します。 このページの英語版をご覧ください。