記事 ID: 000076852 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

PHYLite IP パラメーター・エディターで「コア PLL リファレンス・クロック接続を使用」パラメーターが利用できないのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    パラレル・インターフェイスの PHY Lite インテル® Stratix® 10 FPGA
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

Quartus® Prime ソフトウェア・バージョン 17.0 以降、PHYLite IP はコア PLL リファレンス・クロック接続をサポートしません。PHYLite PLL リファレンス・クロックは、専用のリファレンス・クロック・ピンに接続されている必要があります。

関連製品

本記事の適用対象: 1 製品

インテル® Arria® 10 FPGA & SoC FPGA

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