記事 ID: 000076798 コンテンツタイプ: トラブルシューティング 最終改訂日: 2018/03/16

ユーザーモードのインテル® Stratix® 10 FPGA 3V I/O に関する既知の問題はありますか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    はい、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションバージョン 17.1 アップデート 2 またはそれ以前の既知の問題により、インテル® Stratix® 10 FPGAsの 3V I/O がデザイン内のスタティック GND に割り当てられている場合、出力ピンで反転が見られる場合があります。

    3V I/O は、I/O バンク 6A、6B、6C、7A、7B、7C に配置され、インテル® Stratix® 10 デバイスのさまざまな集積度とパッケージタイプで利用できます。

    解決方法

    これを回避するには、入力を使用して 3V I/O をドライブするか、信号割り当てをクロックド・プロセスに配置します。

    これは、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションの今後のリリースで修正される予定です。

    関連製品

    本記事の適用対象: 1 製品

    インテル® Stratix® 10 FPGA & SoC FPGA

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