記事 ID: 000076578 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

PCI* Express で インテル® FPGA P タイル Avalon®メモリーマップド IP を使用している場合、GUI の「PCIe0 Link」タブが見つからないのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • Avalon-MM インテル® Stratix® 10 PCI Express* のハード IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション v20.1 では、インテル® FPGA P タイル Avalon® PCI* Express"PCIe0 Link"タブのメモリーマップド IP が IP GUI に表示されていません。

    この問題により、ユーザーがコネクターから「スロットクロック」基準クロックを有効または無効にできなくなります。

    解決方法

    この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション v20.2 以降修正されています。

    関連製品

    本記事の適用対象: 2 製品

    インテル® Agilex™ 7 FPGA & SoC FPGA F シリーズ
    インテル® Stratix® 10 DX FPGA

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