記事 ID: 000076519 コンテンツタイプ: トラブルシューティング 最終改訂日: 2019/05/30

Arria® 10 PHYLite IP および Stratix® 10 PHYLite IP は、1 つの I/O レーンで 2 つの x4 DQ/DQS グループをサポートできますか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    パラレル・インターフェイスの PHY Lite インテル® Arria® 10 FPGA
    パラレル・インターフェイスの PHY Lite インテル® Stratix® 10 FPGA
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

いいえ、Arria® 10 PHYLite IP および Stratix® 10 PHYLite IP は、1 つの I/O レーンで 2 つの x4 DQ/DQS グループをサポートできません。各 x4 DQ/DQS グループは、別々の I/O レーンに配置する必要があります。

解決方法

関連製品

本記事の適用対象: 2 製品

インテル® Arria® 10 FPGA & SoC FPGA
インテル® Stratix® 10 FPGA & SoC FPGA

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