記事 ID: 000076464 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/28

RapidIO IP Core Customer Testbench が、リファレンス・クロック周波数の不一致で一部のArria V バリエーションのシミュレーションに失敗

環境

  • インテル® Quartus® II サブスクリプション・エディション
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    クリティカルな問題

    詳細

    RapidIO MegaCore ファンクション x 1 5.00 Gbaud のテストベンチ Arria V デバイスを対象とするバリエーションでは、シミュレーションに失敗する可能性があります。 バイト順序の不一致を引き起こす基準クロック周波数 RX トランシーバーから。

    解決方法

    この問題を回避するには、基準クロック周波数を次に設定します。 RapidIO パラメーター・エディターで 200 MHz または 500 MHz を生成する前に RapidIO MegaCore ファンクションに対応しています。

    この問題は、RapidIO MegaCore のバージョン 11.1 SP2 で修正されています。 関数。

    関連製品

    本記事の適用対象: 1 製品

    Stratix® FPGAs

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