記事 ID: 000076366 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/28

インテル® Quartus® II ソフトウェアのバージョン 13.1.1 およびバージョン 13.1.2 では、V SoC およびArria V SoC ハード・プロセッサー・システム SDRAM のキャリブレーションに失敗するCyclone

環境

    インテル® Quartus® II サブスクリプション・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus®® II ソフトウェア・バージョン 13.1.1 および 13.1.2 で生成されたハンドオフ・ファイルから HPS プリローダーをコンパイルすると、SDRAM キャリブレーションはステージ 1、サブステージ 1 ですぐに失敗します。 以下のようなエラーメッセージがコンソールに出力されます。

 

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U-Boot SPL 2012.10

SDRAM: MMR レジスターの初期化

SDRAM: PHY のキャリブレーション

SEQ。C: メモリーキャリブレーション開始の準備

SEQ。C: キャリブレーションに失敗しました

### ERROR ### ボードをリセットしてください###

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SoC デバイスのキャリブレーション・デバッグ・レポートを有効にすると、コンソールに以下のようなエラーメッセージが出力されます。

 

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U-Boot SPL 2013.01.01 ボード: Altera SOCFPGA Cyclone V ボード

SDRAM: MMR レジスターの初期化

SDRAM: PHY のキャリブレーション

SEQ。C: メモリーキャリブレーション開始の準備

SEQ。C: キャリブレーションに失敗しました

SEQ。C: キャリブレーションの概要

SEQ。C: キャリブレーションに失敗しました

SEQ。C: エラーステージ: 1

SEQ。C: Error Subスクサンプション: 1

SEQ。C: エラーグループ: 0

### ERROR ### ボードをリセットしてください###

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このエラーは、プリロード・ファイルのコンパイルに使用された SoC EDS のバージョンに関係なく、Quartus® II ソフトウェア・バージョン 13.1.1 および 13.1.2 によってプリロード・ハンドオフ・ファイルが生成された場合に発生します。

解決方法

このエラーは、Quartus® II ソフトウェア・バージョン 13.1.3 で修正されています。 このエラーを解決するには、QSys バージョン 13.1.3 で SoC システムを再生成し、Quartus® II ソフトウェアのバージョン 13.1.3 でデザインを再コンパイルし、SoC プリロードを再生成します。

 

関連製品

本記事の適用対象: 5 製品

Arria® V ST SoC FPGA
Cyclone® V SE SoC FPGA
Cyclone® V ST SoC FPGA
Cyclone® V SX SoC FPGA
Arria® V SX SoC FPGA

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