記事 ID: 000076350 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

pci* Express 向け Avalon®-ST インテル® Stratix® 10 ハード IP でreset_status信号が deasserted されているのに、なぜreset_status信号が反応しないのでしょうか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • Avalon-ST インテル® Stratix® 10 PCI Express* のハード IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    クリティカルな問題

    詳細

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションのバージョン 19.2 以前では、AVALON® -ST インテル® Stratix® 10 PCI Express IP のハード IP に問題があるため、上記の問題が発生する可能性があります。

    解決方法

    この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションのバージョン 19.3 から修正されています。

    関連製品

    本記事の適用対象: 4 製品

    インテル® Stratix® 10 GX FPGA
    インテル® Stratix® 10 MX FPGA
    インテル® Stratix® 10 TX FPGA
    インテル® Stratix® 10 SX SoC FPGA

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