記事 ID: 000076335 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

インテル® Stratix® 10 MX HBM2 コントローラーを使用すると、AXI* スイッチからの読み出し可能信号が切り替わりますか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    外部メモリー・インターフェイス・インテル® Stratix® 10 FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

これは、疑似 BL8 を有効化する際の AXI* スイッチの予期される動作です。AXI* スイッチは、次の書き込み要求を受信する前に、トランザクションの書き込みデータ転送が完了するのを待機する必要があります。これは、AXI* インターフェイスの効率には影響しません。

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インテル® Stratix® 10 MX FPGA

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