記事 ID: 000076274 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

シミュレーションでCyclone V またはStratix V Altera_PLL リセットポートが反転しているのはなぜですか?

環境

    リセット
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細 インテル® Quartus® ソフトウェアの問題により® II ソフトウェア・バージョン 13.1 では、ゲートレベル・シミュレーションで plL リセットポートAlteraが反転していることがわかります。この問題は、Cyclone® V または Stratix® V デザインで、Altera_PLL でアドバンスト・モードまたはリコンフィグレーションが有効になっている場合に発生します。
解決方法

ModelSim* でこの問題を回避するには、次のスイッチを vlog コマンドに追加します。

POSTFIT_SIM_USE_ICD_PLL_MODELの定義

例えば、*_run_msim_gate_verilog.do ファイルに次の行を追加します。

Cyclone V デザイン向け

vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/mentor/cyclonev_*.v
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/cyclonev_atoms.v
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL

Stratix V デザイン向け

vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/mentor/stratixv_*.v
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/stratixv_atoms.v
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL

/quartus/eda/sim_lib/altera_primitives.v
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/altera_lnsim.sv
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/220model.v
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/sgate.v
vlog define POSTFIT_SIM_USE_ICD_PLL_MODEL /quartus/eda/sim_lib/altera_mf.v
vsim  -t 1ps transport_int_delays transport_path_delays -voptargs= acc gate_work.

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本記事の適用対象: 8 製品

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