記事 ID: 000075587 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/07/19

PCI Express 向け R タイル Avalon® ストリーミング・インテル® FPGA IPのデザイン例で、PCI Express リファレンス・クロック入力ピンの CML I/O 規格を使用するのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • デザイン例 - コンポーネント
  • PCI Express*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    PCI Express 向け R タイル・Avalon®・ストリーミング・インテル® FPGA IPのデザイン例の問題により、PCI Express リファレンス・クロック入力ピンのデフォルトの I/O 規格は CML です。

    解決方法

    PCI Express ベース仕様および インテル Agilex® デバイスファミリーのピン接続ガイドラインに従って、リファレンス・クロック入力ピンは HCSL I/O 規格に設定する必要があります。

    この問題は、インテル® Quartus® Prime Pro Edition ソフトウェア 21.3 で修正されています。

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    エラー (12341): 入力ピンには HCSL I/O 規格がありますが、選択されたデバイスは HCSL I/O 規格を使用した入力ピンの動作をサポートしていません。

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    インテル® Agilex™ I シリーズ FPGA & SoC FPGA

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