記事 ID: 000075533 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

イーサネット・インテル® FPGA IP コア向け 1588/PTP 10/25G E タイル・ハード IP で「min_pulse_width」タイミング違反が発生するのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • イーサネット
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    クリティカルな問題

    詳細

    インテル® Quartus® Prime ソフトウェア・バージョン 18.0.1 の問題により、イーサネット・インテル® FPGA IP コア向け 10/25G 1588/PTP E タイル・ハード IP で「min_pulse_width」タイミング違反が発生する可能性があります。

    解決方法

    この問題の回避策はありません。

    この問題は、インテル® Quartus® Prime ソフトウェアの今後のリリースで修正される予定です。

    関連製品

    本記事の適用対象: 1 製品

    インテル® Stratix® 10 TX FPGA

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