記事 ID: 000074989 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/28

PCI Express* IP コアのStratix V ハード IP が、完了タイムアウト・エラーの最初のエラーポインターのログに失敗する

環境

  • インテル® Quartus® II サブスクリプション・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    クリティカルな問題

    詳細

    PCI Express* IP コアのStratix V ハード IP のログの完了 レジスターのタイムアウト・エラー Uncorrectable Error Status 高度なエラーで完了タイムアウトエラーはログに記録されません Header Log Register First Error Pointer Advanced Error Capabilities and Control のセクション 7.10.7で説明されているように、レジスターのレポート (AER) またはフィールド PCI Express Base 仕様 (Rev. 3.0)

    解決方法

    回避策はありません。

    関連製品

    本記事の適用対象: 1 製品

    インテル® プログラマブル・デバイス

    ご質問はこちらへ

    サポートに問い合わせる

    免責事項

    1

    本サイトでのすべてのコンテンツの投稿および使用には、Intel.com の利用規約が適用されます。

    このページのコンテンツは、元の英語のコンテンツを人力翻訳および機械翻訳したものが混在しています。この内容は参考情報および一般的な情報を提供するためものであり、情報の正確さと完全性を保証するものではありません。インテルは不正確な翻訳があった場合でもいかなる責任を負いません。このページの英語版と翻訳の間に矛盾がある場合は、英語版に準拠します。 このページの英語版をご覧ください。