記事 ID: 000074498 コンテンツタイプ: トラブルシューティング 最終改訂日: 2019/12/15

インテル® Stratix® 10 データシートのトランシーバー REFCLK フェーズ・ノイズ仕様は、差動フェーズ・ノイズまたは最大シングルエンド・フェーズ・シフトを参照していますか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    インテル® Stratix® 10 デバイス・データシートのトランシーバー REFCLK フェーズ・ノイズ仕様は、最大シングルエンド・フェーズ・シフトではなく、差動フェーズ・ノイズを参照します。

    インテル® Stratix® 10 デバイス・データシートを参照

    解決方法

    インテル Stratix® 10 デバイス・データシートに備考が追加されます。

    関連製品

    本記事の適用対象: 1 製品

    インテル® Stratix® 10 FPGA & SoC FPGA

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