記事 ID: 000074206 コンテンツタイプ: エラーメッセージ 最終改訂日: 2021/08/28

警告 (12010): 「ALTLVDS_RX_component」のエンティティーのインスタンス化に関するポート「rx_fifo_reset」が幅 1 の信号に接続されている。モジュール内の信号の正式な幅は次の形式です。 <number_of_channels>.余分なビットは GND によって駆動されます。</number_of_channels>

環境

  • インテル® Quartus® II サブスクリプション・エディション
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    Quartus® II ソフトウェア・バージョン 10.0 のALTLVDS_RXメガファンクションでは、rx_fifo_resetに必要な入力ポート数が正しく作成されません。 このポートの幅はチャネル数に等しい必要があります。

    解決方法

    この問題を回避するには、デザインでALTLVDS_RXメガファンクションの HDL バリエーション・ファイルを開き、rx_fifo_resetのポート幅を手動で編集します。

    ポート幅は[number_of_channels-1:0]の形式に従う必要があります。

    この問題は、Quartus® II ソフトウェア・バージョン 10.0SP1 で修正されています。

    関連製品

    本記事の適用対象: 5 製品

    Stratix® III FPGA
    Arria® II GX FPGA
    Stratix® IV E FPGA
    Stratix® IV GX FPGA
    Stratix® IV GT FPGA

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