記事 ID: 000074178 コンテンツタイプ: トラブルシューティング 最終改訂日: 2019/01/17

インテル Stratix 10 FPGAsでライセンスされた インテル® FPGA IP の評価モードで®テザリングが失敗する原因は何ですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • HDMI*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションの既知の問題により、インテル FPGA評価 IP のテザリングモードが インテル Stratix® 10 デザインで失敗し、評価がタイムアウトします。

    解決方法

    この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション バージョン 19.1 で修正されています。

     

     

     

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    本記事の適用対象: 1 製品

    インテル® Stratix® 10 FPGA & SoC FPGA

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