記事 ID: 000073951 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/12

FPGA ファブリックにエクスポートされた Cyclone®V HPS EMAC emac*_tx_clk のクロック周波数がタイミング解析で 100Mhz と表示されるのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・スタンダード・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    Quartus® Prime Starndard Edition ソフトウェア・バージョン 20.1 以前の問題により、HPS EMAC を有効化し、Cyclone® V SoC の FPGA にルーティングすると、GMII クロック周波数が 100Mhz であることがわかります。

    解決方法

    Cyclone® V SoC HPS でこの問題を回避するには、cv_soc_rgmii_5csxfc6_hps_0_fpga_interfaces.sdc で emac*_tx_clk の周期を 10ns から 8ns に修正する必要があります。

    関連製品

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    Cyclone® V FPGA & SoC FPGA

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