記事 ID: 000073858 コンテンツタイプ: トラブルシューティング 最終改訂日: 2015/01/01

インテル® SoC FPGA Embedded Development Suite (SoC EDS) 18.1 リリースノートのインテル® SOCEDS 18.1 スタンダード・バージョンで整数オーバーフローの修正が削除されたのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

整数オーバーフローの修正は、 インテル® SoC FPGA Embedded Development Suite (SoC EDS) 18.1 Pro バージョンで修正されています。

解決方法

インテル® SoC FPGA Embedded Development Suite (SoC EDS) 18.1 Standard バージョンを使用している場合は、以下の GitHub から U-Boot コードを取得してください。

https://github.com/robseb/socfpgaPlatformGenerator

関連製品

本記事の適用対象: 1 製品

インテル® Arria® 10 FPGA & SoC FPGA

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