EMIF キャリブレーションに関するよくある質問、既知の問題、チェックリスト
外部メモリー・インターフェイスの EMIF キャリブレーションの問題のトラブルシューティングのために、FAQ とチェックリストが提供されています。
本ガイドラインは、インテル® FPGA デバイス上で UniPHY を使用する外部メモリー・インターフェイス・デザインのキャリブレーションに失敗した場合のトラブルシューティングに役立ちます。これは、工場のアプリケーション・チームに技術支援を求める前に、デザイン上の最初のデバッグのステップを行うためのものです。本ガイドラインは、キャリブレーションの失敗を引き起こした原因を特定するのに役立ちます。このガイドラインがすべての可能性を網羅しているわけではありませんが、キャリブレーションの失敗につながり得る条件の大部分を特定しています。
キャリブレーション失敗のトラブルシューティングについてのチェック項目
数 |
質問 |
はい / いいえ |
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1. |
Quartus® Prime または Quartus® II ソフトウェアで、時間をクローズできるデザインですか?DDR タイミングはクリーンです。 |
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2. |
ボード・レイアウトは、EMI ハンドブックのボード・レイアウト・ガイドラインに従っています。 |
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3. |
デザインのピンの配置は、ピンのガイドラインに従っています。 |
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4. |
デバイスとインターフェイスは、スペック・エスティメーターに記載されているように、コンフィグレーションをサポートできます。 |
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5. |
Quartus® Prime または Quartus® II ソフトウェアのメモリー・パラメーターは、コンフィグレーションおよび条件を正確に表しています。 |
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6. |
OCT と ODT の設定は正しいです。 |
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7. |
シングルランク DDR3 向けの、GUI 設定を「ダイナミック ODT オフ」に設定します |
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8. |
使用しているインターフェイスの正しいメモリー・タイミング・パラメーターが、Quartus® Prime または Quartus® II ソフトウェアに入力されています。 |
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9. |
Quartus® Prime または Quartus® II ウィザードに、正確なボードスキューが入力されていますか? |
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10. |
問題は、Quartus® Prime または Quartus® II ソフトウェアの以前のバージョンで生じていましたか? |
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11. |
Quartus® Prime または Quartus® II ソフトウェアのバージョンをアップグレードする際は、IP を再生成してください。 |
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12. |
Nios® II シーケンサーが RLDRAM* II または QDR* II インターフェイスで失敗した場合、 RTL シーケンサーを試してみましたか? |
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13. |
すべての電圧レベルが正しいことを確認するために、電圧の供給を確認しましたか?電圧のリストは、以下の通りです。
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14. |
アドレス / コマンド信号の終了が正しく処理されていますか? |
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15. |
アドレス / コマンド信号センターは、メモリーサイドのメモリークロックと一致していますか? |
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16. |
フローティング DM ピンがありますか? |
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17. |
OCT ピン接続と OCT ルールはボードに適用されていますか? |
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18. |
ボード上の FPGA およびインターフェイスサイドの両方で、Rup / Rdn または Rzq ピンは適切に接続されていますか? |
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19. |
UniPHY のデフォルトの制約を変更しましたか? |
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20. |
問題は、この PCB にだけ存在しますか、それとも多数の PCB に存在していますか? |
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21. |
異なる動作温度で、デザインがパスしますか? |
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22. |
各 DQ グループの信号間のスキューは、50ps 以下ですか? |
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23. |
Quartus® Prime または Quartus® II レポートに、警告メッセージが存在するかどうか確認してください。 |
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24. |
低い動作フリークエンシーで実行する場合には、デザインはパスしますか? |
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25. |
より速いメモリー・パーツのメモリーを使用すると、デザインはパスしますか? |
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26. |
問題のあるスタンドアロン・インターフェイスを実行して、他のすべてのインターフェイスの電源を停止してください。パスしますか? |
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27. |
同じデバイスとメモリー設定を使ってデザイン例を生成して、同じピンのアサインメントを適用してください。パスしますか? |
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