Stratix® V FPGA

インテルの 28nm Stratix® V FPGA は、ハイエンド・アプリケーション向けの高帯域幅、高レベルのシステム・インテグレーション、卓越した柔軟性を実現します。

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Stratix® V FPGA

アーキテクチャー

機能の概要

機能 Stratix® V E FPGA Stratix® V GS FPGA Stratix® V GX FPGA
高性能アダプティブ・ロジック・モジュール (ALM) 359,200 262,400 359,200
高精度 DSP ブロック (18x18) 704 3,926 798
M20K メモリーブロック数 2,640 2,567 2,660
外部メモリー・インターフェイス ○ ○ ○
パーシャル・リコンフィグレーション ○ ○ ○
フラクショナル・フェーズロック・ループ (PLL) 数 ○ ○ ○
デザイン・セキュリティー ○ ○ ○
Single Event Upset (SEU) の緩和 ○ ○ ○
PCI Express* Gen3、Gen2、Gen1 ハード化 IP ブロック 2 (最大) 4 (最大)
エンベデッド・ハード IP ブロック ○ ○
トランシーバー (データレート / トランシーバー・チャネル数) 14.1Gbps/48 14.1Gbps/66
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Stratix® V FPGA ファミリーには、次のデバイスタイプがあります。

  • Stratix® V GX FPGA (トランシーバー内蔵): 14.1Gbps で動作する最大 66 個の全二重トランシーバーと 933MHz で動作する最大 6 個の 72 ビット DIMM DDR3 メモリー・インターフェイスを統合。
  • Stratix® V GS FPGA (強化トランシーバー内蔵で、より多くのデジタル信号処理 (DSP) 機能を装備): 最大 3,926 個の 18x18 ビットの高性能可変精度マルチプライヤー、14.1Gbps で動作する最大 48 個の全二重トランシーバー、および 933MHz で動作する最大 6 個の 72 ビット DIMM DDR3 メモリー・インターフェイスを統合。
  • Stratix® V E FPGA: 最大 950K のロジックエレメント (LE)、52 メガビット (MB) の RAM、704 個の 18x18 ビット高性能の可変精度マルチプライヤー、840 個の I/O。

その他のリソース

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サポートリソース

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開発ボード

インテル® FPGA とそのパートナーは、FPGA の設計プロセスを加速する、さまざまな開発ボードやハードウェア・ツールを提供しています。

知的財産

インテル® FPGA IP ポートフォリオは、ソフトおよびハードの IP コアの組み合わせとリファレンス・デザインにより、多様なアプリケーションに対応します。

デザインツール

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