インテル® FPGA FIR II IP コア

インテル® FPGA FIR II IP コアは、インテル® FPGA デバイスでの使用に最適化された、完全に統合された有限インパルス応答 (FIR) フィルター機能を提供します。FIR II IP コアは、インタラクティブなパラメーター・エディターを備えており、カスタム FIR フィルターを簡単に作成することができます。パラメーター・エディターは、Verilog HDL および VHDL シミュレータで使用できる IP 機能シミュレーション・モデル・ファイルを出力します。パラメーターエディターでは、シングルレート、デシメーション、補間、フラクショナル・レートなど、さまざまな種類のフィルターを実装することができます。

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インテル® FPGA FIR II IP コア

多くのデジタルシステムでは、不要なノイズを除去したり、スペクトルを整形したり、信号の検出や解析を行ったりするために、信号のフィルタリングが行われています。これらの機能を実現するのが、FIR フィルタや IIR (Infinite Impulse Response) フィルターです。代表的なものには、信号のプリコンディショニング、バンド・セレクション、ローパス・フィルタリングなどがあります。

機能

  • 以下のようなハードウェアの最適化により、最大限の設計効率を実現します。
  • 補間
  • デシメーション
  • シンメトリー
  • デシメーション・ハーフ・バンド
  • 時間共有
  • Avalon ストリーミング (Avalon-ST) インターフェイスを使用した簡単なシステム統合。
  • 論理素子 (LE) とメモリーブロック (M512、M4K、M9K、M10K、M20K、または M144K) 間の実装のバランスをとるためのメモリと乗算器のトレードオフ。
  • ランタイム係数リロード機能と複数の係数バンクのサポート。
  • ユーザーが選択可能な出力精度 (切り捨て、飽和、丸め)。

その他のリソース

IP のご紹介

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この IP コアの技術サポートについては、サポートリソースまたはインテル® プレミア・サポートをご覧ください。また、ナレッジセンターおよびコミュニティーで、この機能に関連するトピックを検索することもできます。

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