Arria® V GX FPGA スターター開発キット

インテルでは、Arria® V GX FPGA スターター開発キットの生産は終了しています。製品の生産終了に関する情報は、PDN2025 通知にてご覧いただけます。現在のインテル® FPGA 開発キットについては、すべての開発キットのページをご覧ください。

Arria® V GX FPGA スターター開発キット

Arria® V GX FPGA スターター開発キットは、コスト重視の FPGA アプリケーションを迅速に開発するために必要なすべてのハードウェアとソフトウェアを含む完全なデザイン環境を提供します。開発キットには、以下のものが含まれています。

  • Arria® V GX FPGA - 360KLE、F1152 パッケージ、24 X 6.5G トランシーバー、C5 スピードグレード
  • 1 個の I/O 拡張スロット — 1 個の高速メザニン・カード (HSMC) コネクター
  • 256MB の SDRAM メモリー
  • 高精細マルチメディア・インターフェイス (HDMI) およびシリアル・デジタル・インターフェイス (SDI) 接続
  • SMA

表 1.Arria® V GX FPGA スターター開発キットの注文コードと価格情報

注文コード 価格 注文情報
DK-START-5AGXB3N

$850

(提供されていません)

 Arria® V GX FPGA スターター開発キットには、5AGXB3 デバイスとインテル® Quartus® Prime 開発ソフトウェアの 1 年間のライセンスが付属しています。
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注意：

ご購入の対象となる方は、製品開発者、ソフトウェア開発者、システム・インテグレーターの方々です。また、この製品が FCC 認定を受けていない開発キットであり、あくまで評価目的およびソフトウェア開発目的にのみ提供されることをご了承ください。再販は認められません。

スターター開発キットの内容

  • Arria® V GX FPGA スターター開発キットには、以下のものが含まれます。
  • Arria® V GX FPGA 開発ボード
  • FPGA: Arria® V GX 5AGXFB3H4F35C4N
  • システム・コントローラー: MAX® V 5M2210ZF256C4N デバイス
  • パワーモニター GUI
  • 1 個のアナログ・デジタル・コンバーター (ADC)、8 チャネル
  • 非絶縁電源レール
  • パラレル・フラッシュ・ローダ (PFL) によるファースト・パッシブ・パラレル (FPP) x16 モード
  • コントロール・レジスターおよびステータスレジスター
  • エンベデッド USB-BlasterTM II: インテル® MAX® II EPM570GM100C4N デバイス
  • HDMI 1.3 TX
  • 4 個のトランシーバー、最大 2.7Gbps (レベルシフターによる)、および 270MHz TX クロックの HDMI TX コネクター
  • STMicroelrynics HDMI レベルシフター STHDLS101
  • レベルシフト・トランシーバー PCML 1.5V <-> TMDS レベル
  • DDC および HPD <-> HDMI 準拠レベル
  • 最大 2.7Gbps のデータチャネル、HDMI 1.3 準拠
  • 最大 270MHz のクロックチャネル、 最大 2.7Gbps データレートに十分対応可能
  • HDMI 仕様: クロック周期 = UI の 10 倍
  • SDI 3G
  • 1 個のトランシーバー TX/RX ループバック
  • 2 個の SMB コネクターおよびケーブル (ケーブルはキットには含まれません)
  • 最大 2.97Gbps
  • National Semiconductor ドライバー / レシーバー LMH0384SQ / LMH0303SQX を使用
  • 米国および EU 規格に対応するためには、トランシーバーの基準クロックには、それぞれ には、それぞれ 148.5MHz、148.35MHz が必要です
  • VCXO を使用して微調整し、リカバリ CDR 周波数にロック
  • HSMC
  • 8 個の最大 6.375Gbps のトランシーバー
  • PCI Express* (PCIe) HIP ピン・アサインメント非準拠
  • 4 個の CMOS
  • 8 個の TX および 9 個の RX 差動インターフェイス (専用 TX / RX チャネルを使用)
  • 2 個の Low-Voltage Differential Signaling VDS) クロック入力
  • 2 個の差動クロック出力
  • I2C
  • JTAG
  • 最小電流のサポート
  • 2A @ 3.3V
  • 1A @ 12V
  • Si 5338 クロック・ジェネレーターからのトランシーバー基準クロック専用クロック・ドメイン
  • BTS GUI を備えた HSMC ループバック
  • SMA
  • 1 個のトランシーバー TX/RX チャネル
  • 1 個の LVPECL クロック入力
  • 1 個の LVPECL クロック出力
  • Si 5338 クロック・ジェネレーターからのトランシーバー基準クロック専用クロック・ドメイン
  • DDR3 SDRAM x32
  • Micron MT41J64M16LA-15E DDR3 SDRAM 8MX16X8
  • 2 個のデバイス: 2 x 16 幅 = x32
  • UniPHY およびハイ・パフォーマンス (HP) コントローラ II を使用する BTS DDR3 SDRAM GUI
  • SSRAM
  • 512K x 36、18Mb ISSI IS61VPS51236A
  • アドレスまたはデータをフラッシュと共有
  • ユーザー IO
  • LCD キャラクター
  • 4 個の DIP スイッチ
  • 3 個のプッシュボタン
  • 4 個の LED
  • コンフィグレーション
  • FPP x 16 モード
  • デュアル・フラッシュ 512 メガビット Numonyx PC28F512P30BF (52 MHz fMAX)
  • JTAG ヘッダー
  • エンベデッド USB Blaster II
  • USB PHY 2.0 として Cypress マイクロコントローラー CY7C68013A を搭載
  • MAX® II デバイス
  • イーサネット
  • 10 / 100 / 1000 Base-T
  • RJ-45 コネクター、リンクのステータス表示用オンボード LED
  • Marvell イーサネット PHY 88E1111
  • クロック入力から 50MHz クロックが必要

表2.Arria® V GX FPGA スターター開発キットの資料

ドキュメント

詳細

バージョン

Arria® V GX スターター開発キット・ボード・リファレンス・マニュアル (PDF)

オンボード・コンポーネントとインターフェイスに関する情報を含む詳細なドキュメント

1.2

Arria® V GX スターター開発キット・ユーザーガイド (PDF)

Arria® V GX FPGA スターター開発キット開発ボードのセットアップおよび付属ソフトウェアの使用に関する情報

1.2

キットのインストール

(FTP 経由)

(アップデート) リファレンス・マニュアル、ユーザーガイド、クイック・スタート・ガイド、部品表、レイアウト、PCB、回路図、デザイン例など、キット固有のすべてのファイルのフル・インストール

Quartus II 開発ソフトウェア・バージョン 12.1 SP1 で 5AGXFB3H4F35C4 デバイスを選択しコンパイル可能

12.1.1.1

キットのインストール

(FTP 経由)

(アーカイブ) リファレンス・マニュアル、ユーザーガイド、クイック・スタート・ガイド、部品表、レイアウト、PCB、回路図、デザイン例など、キット固有のすべてのファイルのフル・インストール

Quartus II 開発ソフトウェア・バージョン 12.1 SP1 で 5AGXFB3H4F35C4 デバイスを選択しコンパイル可能

12.1.1.0

キットのインストール

(FTP 経由)

(アーカイブ) リファレンス・マニュアル、ユーザーガイド、クイック・スタート・ガイド、部品表、レイアウト、PCB、回路図、デザイン例など、キット固有のすべてのファイルのフル・インストール

12.1.0.0

キットのインストール

(FTP 経由)

(アーカイブ) リファレンス・マニュアル、ユーザーガイド、クイック・スタート・ガイド、部品表、レイアウト、PCB、回路図、デザイン例など、キット固有のすべてのファイルのフル・インストール

12.0.0.1
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