Cyclone® IV FPGA
Cyclone® IV FPGA ファミリーは、トランシーバーのオプションによりインテル® Cyclone® FPGA シリーズの低消費電力 FPGA 提供におけるリーダーシップを推進します。大規模、コスト重視のアプリケーションに理想的な Cyclone® IV FPGA ファミリーは、帯域幅要件の高まりに対応します。 この製品ファミリーは、エッジ中心のアプリケーションやデザインにお勧めします。
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電源Powerエンベデッド・マルチプライヤー (PDF)メモリーブロック (PDF)クロック・ネットワーク & PLL (PDF)コンフィグレーションとリモート・システム・アップグレード (PDF)SEU の緩和 (PDF) | トランシーバー外部メモリー・インターフェイスI/O 機能 (PDF)I/O features (PDF) |
完全なデザインリソース
アイデアをすばやく収益に結び付けるためのスムーズで効果的なデザインフローを実現するよう、インテルは以下を含む Cyclone® IV FPGA のデザイン環境を提供します。
Cyclone® IV GX FPGA: トランシーバーの概要
Cyclone® IV FPGA ファミリーは、新たにトランシーバーを搭載することにより、市場有数の低コスト、低消費電力の FPGA の提供において、インテル® Cyclone® FPGA シリーズのリーダーシップを拡大します。
低コストなトランシーバーは、すべて同じというわけではありません。Cyclone® IV GX FPGA は特に、1 つのクアッドへの複数のプロトコルの実装、また、受信用、送信用に独立した周波数を持てるように設計されました。こうした柔軟性により、あらゆるトランシーバーのリソースを活用し、より小さなかつ低コストなデバイスの設計を助けます。トランシーバーの主な機能:
- 最大 8 個のトランシーバーは、クロック・データ・リカバリー (CDR) 機能を備え、600Mbps ~ 3.125Gbps のデータレートをサポート。柔軟で容易に設定できるトランシーバー・データパスで、業界標準のプロトコルおよび独自プロトコルを実装。プログラマブル・プリエンファシス設定、および調整可能な差動出力電圧 (VOD) による、シグナル・インテグリティーの向上。ユーザーが管理するな受信側イコライゼーションにより、物理メディアにおける周波数依存損失の補正。トランシーバーのダイナミック・リコンフィグレーションにより、FPGA を再プログラミングすることなく、同一チャネル上で複数のプロトコルおよびデータレートをサポート。PCI Express*、DisplayPort、V-by-One、および SATA コンフィグレーションでのスペクトラム拡散クロッキングなどのプロトコル機能をサポート。PCI Express*、XAUI、およびギガビット・イーサネット向けの物理インターフェイスに準拠した専用回路。PCI-SIG 準拠 x1、x2、または x4 エンドポイントまたはルートポート・アプリケーションをサポートする内蔵 PCI Express Gen1 (2.5Gbps) のハードIP (Intellectual Property) に直接接続する PIPE インターフェイス。トランスミッターごとに 2 個のフェーズロック・ループ (PLL) 入力を内蔵。また、EP4CGX50 以上のデバイスは、チャネルごとに異なるクロックレートをサポートする独立したクロック・ディバイダーも搭載。内蔵のバイト・オーダリング機能により、フレームまたはパケットが常に既知のバイトレーンで開始。8B / 10B エンコーダー / デコーダーは 8 ビットから 10 ビットへのエンコーディング、および 10 ビットから 8 ビットへのデコーディングをサポート。トランスミッターおよびレシーバー PLL チャージポンプ向けのオンダイ電源レギュレーター、そしてノイズ耐性に優れた電圧制御発振器 (VCO)。オンチップ電源の分離により、高周波における過渡電流要件を満たし、オンボードの分離キャパシターの必要性を低減。PCI-SIG* 準拠の PCI Express* ハード IP ブロックでのシリアル・ループバック、パラレル・ループバック、リバース・シリアル・ループバック、ループバック・マスターおよびスレーブ機能などの診断機能。以下に Cyclone® IV GX FPGA トランシーバーのフィジカル・メディア・アタッチメント (PMA) およびフィジカル・コーディング・サブレイヤー (PCS) 双方のブロック図を示します。PCS 内のブロックは、必要に応じてバイパス可能です。
Cyclone® IV GX トランシーバー、PMA & PCS ブロック図
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