インテル® Cyclone® 10 LP FPGA

インテル® Cyclone® 10 LP FPGA ファミリーは、低コスト、低消費電力デバイスにおけるインテル® Cyclone® FPGA シリーズのリーダーシップをさらに推進します。量産型のコスト重視の機能に理想的なインテル® Cyclone® 10 LP FPGA は、多様な汎用ロジック・アプリケーション向けの設計です。

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インテル® Cyclone® 10 LP FPGA

I/O 拡張

今日のエンベデッド・システムにおいてますます高度化する性能要求が、マイクロプロセッサーの選択に拍車をかけています。システムに必要な I/O 機能セットをサポートする場合、プロセッサーの性能は固定されたインターフェイスにも依存するため、必要以上に大規模なプロセッサーの選択をしていることも少なくありません。代替オプションとして、最適なプロセッサーと I/O 拡張用のコンパニオン FPGA を併用し、より多くの機能を有効にすることが挙げられます。

インテル® Cyclone® 10 LP FPGA は、500 以上の I/O をサポートするパッケージにより、I2C、SPI、UART、パラレル I/O などのさまざまな IP ブロックをすべて利用できるので、このような用途に最適です。設計者は、設計をプロセッサーに固定されたペリフェラル・セットに限定したり、大規模プロセッサーを使用してシステムコストを増加させたりするのではなく、アプリケーションのニーズに合わせて設計をスケールできます。

インテル® Cyclone® LP FPGA の I/O コントロール・ブロック図
インテル® Cyclone® LP FPGA のブロック図

チップ間インターフェイス

インテル® Cyclone® 10 LP FPGA は、ASSP 間のインターフェイスに最適なソリューションです。具体例として、画像センサーとホスト・プロセッサー間や、プロセッサーとディスプレイ間のインターフェイスが挙げられます。このどちらのシナリオでも、インテル® Cyclone® 10 LP FPGA を使用することで、高フレームレート、低レイテンシー、高い処理スループットを必要とするリアルタイム・アプリケーション用に、インターフェイスと画像パイプライン処理を組み合わせることができます。

アプリケーションの一例として、CMOS 画像センサーで RAW 画像をキャプチャーし、数種類のインターフェイス (DVP、MIPI CSI、または HiSPi) を介してデータを FPGA に出力します。データをホスト・プロセッサーに渡す前に、FPGA を使用して画像を処理するのです。別のチップ間インターフェイスとしては、ビデオソースと LCD 間のインターフェイスとして FPGA を使用する例が挙げられます。さまざまな理由から、入力画像データのビデオ処理が必要になることがあります。この場合、次のような機能を備えたインテルのビデオ IP スイートを使用してビデオ処理を実装できます。

  • デモザイクおよび Bayer フィルタリング。
  • データ形式の変換 (例: YUV から RGB)。
  • サイズの拡大 (例: 1280x720 から 1920x1080 へ)。
  • エンコード / デコード、フィルタリング、ブレンディング、インターレース / デインターレース、トリミングなど

モーター制御

インテル® Cyclone® 10 LP FPGA は、汎用インターフェイス (最大 525 個のユーザー I/O 数) の柔軟性を備えており、モータードライブに対する多様なニーズに応えながら量産アプリケーションを差別化することができます。

各種産業用イーサネット・プロトコルの実装とサポートを容易にするだけでなく、インテル® Cyclone® 10 LP FPGA ファブリックを利用して PWM とエンコーダー・インターフェイスも実装できます。同じモータードライブ機能を並行して何度も繰り返す多軸制御も容易に実現が可能になります。

インテル® Cyclone® 10 LP FPGA ファブリックにインテルの磁界方向制御 (FOC) アルゴリズムと振動抑制 IP コアを組み合わせて実装することで、パフォーマンスの向上とともにレイテンシーの低減が実現します。また、Nios® II プロセッサーをオフロードしてほかのタスク用に解放することもできます。

インテル® FPGA による産業用アプリケーションのサポートの詳細 ›

インテル® Cyclone® LP FPGA のモーター制御ブロック図

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