Arria 10におけるプロトコル経由のCvP初期化およびパーシャル・リコンフィギュレーション ユーザーガイド

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ID 683871
日付 5/02/2016
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ドキュメント目次
ドキュメント目次 x
1. Arria 10におけるCvPの初期化 2. Arria 10におけるCvP初期化に向けたデザインの考慮事項 3. Arria 10におけるCvP初期化に向けた設計の手順の解説 4. CvP ドライバーとレジスター 5. Arria 10におけるプロトコルを経由したパーシャル・リコンフィギュレーション 6. Arria 10におけるPCI Express経由のPRのデザイン・プランニング 7. Arria 10におけるPCI Expressを経由したPRのデザイン・プロセスの解説 A. 改訂履歴
1. Arria 10におけるCvPの初期化 x
1.1. CvPシステム 1.2. CvPを使用するメリット 1.3. Arria 10デバイスに向けたCvPサポート 1.4. CvPの初期化 1.5. CvPの機能 1.6. Autonomousモード 1.7. CvPピン
2. Arria 10におけるCvP初期化に向けたデザインの考慮事項 x
2.1. オープン・システムに向けたCvPの設計 2.2. クローズド・システムに向けたCvPの設計
3. Arria 10におけるCvP初期化に向けた設計の手順の解説 x
3.1. 合成HDLファイルの生成 3.2. Device and Pin OptionsでのCvPパラメータの設定 3.3. デザインのコンパイル 3.4. SOFファイルの分割 3.5. ハードウェアの立ち上げ
3.5. ハードウェアの立ち上げ x
3.5.1. Windows システムへのJungo WinDriver のインストール 3.5.2. Linux システムへのJungo WinDriver のインストール 3.5.3. Arria 10開発キットのMSEL/DIPスイッチの変更 3.5.4. CvPイメージのプログラミング
4. CvP ドライバーとレジスター x
4.1. CvP ドライバーのサポート 4.2. CvPドライバのフロー 4.3. CvP のVSEC レジスター
4.3. CvP のVSEC レジスター x
4.3.1. アルテラ定義のVendor Specific Capability Header レジスター 4.3.2. アルテラ定義のVendor Specific Header レジスター 4.3.3. Altera Marker レジスター 4.3.4. CvP Status レジスター 4.3.5. CvPモード・コントロール・レジスタ 4.3.6. CvP Data レジスター 4.3.7. CvP Programming Control レジスター 4.3.8. Uncorrectable Internal Error Status Register 4.3.9. Uncorrectable Internal Error Mask Register 4.3.10. Correctable Internal Error Status Register 4.3.11. Correctable Internal Error Mask Register
5. Arria 10におけるプロトコルを経由したパーシャル・リコンフィギュレーション x
5.1. PCI Express経由のPRを使用するメリット 5.2. PCIe経由のPRシステム 5.3. パーシャル・リコンフィギュレーションIPコア
6. Arria 10におけるPCI Express経由のPRのデザイン・プランニング x
6.1. パーティション階層の特定 6.2. 複数のリビジョンの作成 6.3. PRデザインのフロアプラン 6.4. PRデザインのクロックおよびグローバル信号のアサインメント 6.5. PRパーティションへのフリーズ・ロジックの挿入
7. Arria 10におけるPCI Expressを経由したPRのデザイン・プロセスの解説 x
7.1. Qsysシステムの作成 7.2. ユーザー・ロジックとトップレベル・ファイルの作成 7.3. PRパーティションの作成 7.4. ベースSOF/RBFビットストリームの生成 7.5. PRリビジョンの作成 7.6. PRビットストリームの生成 7.7. ハードウェアの立ち上げ
1. Arria 10におけるCvPの初期化
2. Arria 10におけるCvP初期化に向けたデザインの考慮事項
3. Arria 10におけるCvP初期化に向けた設計の手順の解説
4. CvP ドライバーとレジスター
5. Arria 10におけるプロトコルを経由したパーシャル・リコンフィギュレーション
6. Arria 10におけるPCI Express経由のPRのデザイン・プランニング
7. Arria 10におけるPCI Expressを経由したPRのデザイン・プロセスの解説
A. 改訂履歴

4.3.9. Uncorrectable Internal Error Mask Register

このレジスターは内部で修正不可能なエラーとして転送されるエラーを制御します。このエラーはCvP モードで検出されるコンフィグレーション・エラー以外はすべて深刻であり、デバイスやPCIe リンクを不整合な状態にすることがあります。CvP モードで検出されたコンフィグレーション・エラーはプログラミング・ソフトウェアのデザインによっては修正が可能な場合もあります。

表 15.  Uncorrectable Internal Error Mask Register (バイトオフセット：0x238)
ビット リセット値 アクセス 説明
[31:12] 0x00 RO 予約済み
[11] 1'b1 RWS ポストされたRX バッファーおよびCompletion オーバーフロー・エラーのマスク
[10] 1'b1 RWS R2CSEB インターフェイス上のパリティーエラーのマスク
[9] 1'b1 RWS Configuration Space からTX へのバス・インターフェイスでのパリティーエラーのマスク
[8] 1'b1 RWS TX からConfiguration Space へのバス・インターフェイスでのパリティーエラーのマスク
[7] 1'b1 RWS トランザクション・レイヤー・パケットのパリティーエラーのマスク
[6] 1'b1 RWS アプリケーション・レイヤーのパリティーエラーのマスク
[5] 1'b0 RWS CvP モードのコンフィグレーション・エラーのマスク
[4] 1'b1 RWS TX Data Link LCRC 生成中に検出されたデータ・パリティーエラーのマスク
[3] 1'b1 RWS RX からConfiguration Space へのバス・インターフェイスで検出されたデータ・パリティーエラーのマスク
[2] 1'b1 RWS RX バッファーへの入力で検出されたデータ・パリティーエラーのマスク
[1] 1'b1 RWS リトライバッファーの修正不可能なECC エラーのマスク
[0] 1'b1 RWS RX バッファーの修正不可能なECC エラーのマスク
レベル 2 の表題