Mailbox Client インテル® Stratix® 10 FPGA IP コア・ユーザーガイド

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ID 683290
日付 4/19/2019
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ドキュメント目次
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1. Mailbox Client インテル® Stratix® 10 FPGA IPコア・ユーザーガイド
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1.1. 機能の説明 1.2. コマンドおよび応答 1.3. Mailbox Client インテル® Stratix® 10 FPGA IP コアの信号 1.4. Mailbox Client インテル® Stratix® 10 FPGA IP コア Avalon® メモリーマップ 1.5. Mailbox Client インテル® Stratix® 10 FPGA IP コアの使用 1.6. Mailbox Client インテル® Stratix® 10 FPGA IP コアの使用例 1.7. Mailbox Client インテル® Stratix® 10 FPGA IP コア・ユーザーガイドの改訂履歴
1.2. コマンドおよび応答 x
1.2.1. 操作コマンド 1.2.2. エラーコードの応答
1.4. Mailbox Client インテル® Stratix® 10 FPGA IP コア Avalon® メモリーマップ x
1.4.1. 割り込みイネーブルレジスター (IER) 1.4.2. 割り込みステータスレジスター
1. Mailbox Client インテル® Stratix® 10 FPGA IPコア・ユーザーガイド

1.4.1. 割り込みイネーブルレジスター (IER)

表 6.  割り込みイネーブルレジスター (IER)イネーブルビットをクリアーすると、対応する割り込みステータスビットの割り込み出力アサーション (IRQ) を無視します。
注: これらのイネーブルビットは、割り込みステータスビットの値がISRに現れないようにするのではなく、割り込みステータスビットの割り込み出力アサーションを防ぐだけです。
ビット フィールド アクセス デフォルト値 説明
31:2 予約済み
1 EN_CMD_FIFO_NOT_FULL R/W 0x0 コマンドFIFOのイネーブルビット割り込みがフルの状態ではありません。
  • 1: 対応する割り込みを有効にします。
  • 0: 対応する割り込みを無効にします。
0 EN_DATA_VALID R/W 0x0 応答FIFOの有効なデータのイネーブルビットです。
  • 1: 対応する割り込みを有効にします。
  • 0: 対応する割り込みを無効にします。
レベル 2 の表題