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2.2.8.5.1. デフォルトのマルチサイクル分析
2.2.8.5.2. End Multicycle Setup = 2およびEnd Multicycle Hold = 0
2.2.8.5.3. End Multicycle Setup = 2およびEnd Multicycle Hold = 1
2.2.8.5.4. デスティネーション・クロックオフセット付きの同じ周波数クロック
2.2.8.5.5. デスティネーション・クロックの周波数がソースクロック周波数の倍数である場合
2.2.8.5.6. デスティネーション・クロックの周波数がオフセットを持つソースクロック周波数の倍数である場合
2.2.8.5.7. ソースクロックの周波数がデスティネーション・クロックの周波数の倍数である場合
2.2.8.5.8. ソースクロックの周波数がオフセットを持つデスティネーション・クロックの周波数の倍数である場合
2.2.8.3. 最小および最大遅延
パスの絶対最小遅延または最大遅延を指定するには、それぞれSet Minimum Delay （set_min_delay）またはSet Maximum Delay （set_max_delay）制約を使用します。 最小遅延と最大遅延を指定すると、既存のセットアップとホールドの関係が最小値と最大値で直接上書きされます。
デザインに特定のクロック関係はないが、最小および最大パス遅延が必要な非同期信号には、set_max_delayおよびset_min_delay制約を使用します。パスのレジスターステージなしで、デバイスを通るポート間パスの最小および最大遅延例外を作成できます。最小遅延例外と最大遅延例外を使用してパス遅延を制約する場合、パスの最小遅延と最大遅延の両方を指定します。最小値または最大値のみを制約しないでください。
ソースノードまたはデスティネーション・ノードにクロックが供給されている場合、Timing Analyzerはクロックパスを考慮して、データパスの遅延を増減させます。送信元または宛先ノードに入力または出力遅延がある場合、最小または最大遅延チェックにはその遅延も含まれます。
タイミングノード間の最小または最大遅延を指定した場合、遅延は2つのノード間のパスにのみ適用されます。クロックの最小または最大遅延を指定すると、遅延がクロックがソースノードまたはデスティネーション・ノードをクロックするすべてのパスに適用されます。
出力遅延制約のない出力ポートに対して、最小または最大遅延例外を作成できます。出力ポートに関連するパスのタイミングを報告することはできません。ただし、Timing Analyzerはセットアップサマリおよびホールドサマリレポートでパスのスラックを報告します。出力ポートに関連するクロックがないため、Timing Analyzerは出力ポートのタイミングパスのクロックをレポートしません。
注: 最小および最大遅延制約のある出力パスのクロックフィルターでタイミングをレポートするには、出力ポートの出力遅延をゼロの値に設定できます。クロックリファレンスとして、デザインの既存のクロックまたは仮想クロックを使用できます。