Intel Agilex® 7 エンベデッド・メモリー・ユーザーガイド

ID 683241
日付 4/10/2023
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ドキュメント目次

2.9. コヒーレント読み出しメモリー

コヒーレント読み出しメモリーの機能を使用すると、単一のクロックサイクルで、同じメモリーコンテンツに書き込まれる出力データを読み出すことができます。つまり、Read-During-Write 操作時に新しいデータ (フロースルー) 動作が発生します。この機能は、M20K ブロックにのみ適用され、シングルクロックのコンフィグレーションでのみサポートされます。

コヒーレント読み出しメモリーの機能を有効にして M20K ブロックをコンフィグレーションし、レジスターされる出力で、Force-to-Zero の機能が無効になっている場合、出力レジスターのデータは、読み出しイネーブル (rden) 信号が Low の際に、コヒーレント読み出し回路を介して保持されます。詳細は、 Intel Agilex® 7 のブロックにおけるコヒーレント読み出しメモリーの動作の図、およびコヒーレント読み出しメモリー回路の簡略ブロック図を参照してください。この回路は、M20K ブロックのラッチからデータをフェッチするのではなく、ループのように動作します。非同期クリア (aclr) もしくは同期クリア (sclr) がアサートされて M20K ブロックの出力レジスターがクリアされると、rden 信号が再度アサートされた後の次のクロックサイクルまで、出力は 0 で保持されます。

図 9.  Intel Agilex® 7 のブロックにおけるコヒーレント読み出しメモリーの動作次の図は、レジスターされる出力とともにコヒーレント読み出しメモリーの機能が有効になっており、Force-To-Zero の機能が無効になっている場合のコヒーレント読み出しメモリーの動作例を表しています。クリア信号が High にアサートされている際に、M20K ブロックは読み出しを行いません。
コヒーレント読み出しメモリーの機能を使用する場合は、次のコンフィグレーションを使用することができません。
  • シンプル・デュアルポート以外の動作モード
  • ポート幅が異なるシンプル・デュアルポート
  • バイト・イネーブル
  • ECC
  • 幅の広いシンプル・デュアルポート
  • デュアルクロックのコンフィグレーション
図 10. コヒーレント読み出しメモリー回路の簡略ブロック図
図 11. 出力がレジスターされない場合のコヒーレント読み出しメモリーの動作次の図は、出力がレジスターされない場合のコヒーレント読み出しメモリーの波形を示しています。
図 12. 出力がレジスターされる場合のコヒーレント読み出しメモリーの動作次の図は、出力がレジスターされる場合のコヒーレント読み出しメモリーの波形を示しています。