Arria 10 SoC 開発キット・ユーザーガイド

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ID 683227
日付 9/05/2017
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ドキュメント目次
ドキュメント目次 x
1. Arria 10 SoC 開発キットの概要 2. スタートガイド 3. 開発ボードのセットアップ 4. ボード・テスト・システム 5. ボード・コンポーネント A. 追加情報
1. Arria 10 SoC 開発キットの概要 x
1.1. 一般概要 1.2. ボード・コンポーネント・ブロック 1.3. 推奨動作条件 1.4. ボードの取り扱い
2. スタートガイド x
2.1. ボード検査 2.2. Quartus Prime 開発ソフトウェアのサブスクリプション・エディションのインストール 2.3. アルテラ SoC エンベデッド開発スイート (EDS) のインストール 2.4. 開発キット・インストーラー 2.5. USB-Blaster ドライバーのインストール 2.6. ソフトウェア例を使用した SD カードイメージ
2.2. Quartus Prime 開発ソフトウェアのサブスクリプション・エディションのインストール x
2.2.1. ライセンスの有効化
3. 開発ボードのセットアップ x
3.1. ボードへの電源供給 3.2. デフォルトスイッチとジャンパーの設定
4. ボード・テスト・システム x
4.1. ボードの準備 4.2. ボード・テスト・システムの実行 4.3. バージョンセレクター 4.4. ボード・テスト・システムの使用
4.4. ボード・テスト・システムの使用 x
4.4.1. Configure メニューの使用 4.4.2. System Info タブ 4.4.3. GPIO タブ 4.4.4. XCVR タブ 4.4.5. PCIe タブ 4.4.6. FMCA タブ 4.4.7. FMCB タブ 4.4.8. DDR3 タブ 4.4.9. DDR4 タブ 4.4.10. EEPROM タブ 4.4.11. Power Monitor 4.4.12. Clock Control
5. ボード・コンポーネント x
5.1. ボードの概要 5.2. 主要デバイス : Arria 10 SoC 5.3. MAX V CPLD 5M2210 システム・コントローラー 5.4. コンフィグレーション 5.5. ステータスエレメント 5.6. セットアップ・エレメント 5.7. 汎用ユーザー入出力 5.8. クロック回路 5.9. コンポーネントとインターフェイス 5.10. メモリー 5.11. ボードの電源
5.4. コンフィグレーション x
5.4.1. システム・コントローラー・コンフィグレーション 5.4.2. オンボード USB-Blaster II 経由の FPGA と I/O MUX CPLD プログラミング 5.4.3. HPS による FPGA プログラミング 5.4.4. EPCQ デバイスによる FPGA プログラミング 5.4.5. 外部 USB-Blaster による FPGA プログラミング
5.6. セットアップ・エレメント x
5.6.1. ボード設定 DIP スイッチ 5.6.2. JTAG チェーン・コントロール DIP スイッチ 5.6.3. リファレンス・クロックソースの選択 5.6.4. CPU リセットボタン 5.6.5. ロジック・リセット・ボタン
5.7. 汎用ユーザー入出力 x
5.7.1. キャラクター LCD
5.8. クロック回路 x
5.8.1. オンボード・オシレーター
5.9. コンポーネントとインターフェイス x
5.9.1. PCI Express 5.9.2. 10/100/1000 イーサネット (HPS) 5.9.3. 10/100/1000 イーサネット (FPGA) 5.9.4. FMC 5.9.5. HPS 共有 I/O 5.9.6. USB 2.0 ポート (HPS) 5.9.7. RS-232 UART (HPS) 5.9.8. リアルタイム・クロック (HPS) 5.9.9. SFP+ 5.9.10. I2C インターフェイス 5.9.11. FPGA 汎用 I/O コンフィグレーション 5.9.12. HPS SPIO インターフェイス
5.9.11. FPGA 汎用 I/O コンフィグレーション x
5.9.11.1. FPGA-I/O MAX V インターフェイス 5.9.11.2. LMK04828 コントローラー 5.9.11.3. FPGA 抵抗 MUX 5.9.11.4. FPGA デバッグポート 5.9.11.5. FPGA PMBUS VID 5.9.11.6. FPGA 補助信号
5.10. メモリー x
5.10.1. FPGA 外部メモリー 5.10.2. HPS 外部メモリー 5.10.3. HPS ブート・フラッシュ・インターフェイス 5.10.4. I2C EEPROM 5.10.5. ドータカード
5.11. ボードの電源 x
5.11.1. 電源分配システム 5.11.2. 電力測定
A. 追加情報 x
A.1. ユーザーガイド改訂履歴 A.2. コンプライアンスと適合に関して
A.2. コンプライアンスと適合に関して x
A.2.1. CE EMI 適合への注意
1. Arria 10 SoC 開発キットの概要
2. スタートガイド
3. 開発ボードのセットアップ
4. ボード・テスト・システム
5. ボード・コンポーネント
A. 追加情報

5.9.11.4. FPGA デバッグポート

デバッグポートは、HPS 16 ビット・トレース・デバッグ・ポートと Blaster ダイレクト・デバッグ・ポートの両方をサポートする必要があります。

表 47.  FPGA デバッグポート
バンク ピン番号 回路図上の名前

HPS トレースモード

USER_DIPSW_HPS3 = 0

Blaster ダイレクトポート

USER_DIPSW_HPS3 = 1
2A AM19 FTRACE_D0 HPS 16 ビット・トレース・ポート D0 Direct_USB_D0
2A AM16 FTRACE_D1 HPS 16 ビット・トレース・ポート D1 Direct_USB_D1
2A AN16 FTRACE_D2 HPS 16 ビット・トレース・ポート D2 Direct_USB_D2
2A AP16 FTRACE_D3 HPS 16 ビット・トレース・ポート D3 Direct_USB_D3
2A AR16 FTRACE_D4 HPS 16 ビット・トレース・ポート D4 Direct_USB_D4
2A AN19 FTRACE_D5 HPS 16 ビット・トレース・ポート D5 Direct_USB_D5
2A AP19 FTRACE_D6 HPS 16 ビット・トレース・ポート D6 Direct_USB_D6
2A AR18 FTRACE_D7 HPS 16 ビット・トレース・ポート D7 Direct_USB_D7
2A AT18 FTRACE_D8 HPS 16 ビット・トレース・ポート D8 Direct_USB_RDn
2A AR17 FTRACE_D9 HPS 16 ビット・トレース・ポート D9 Direct_USB_Wrn
2A AT17 FTRACE_D10 HPS 16 ビット・トレース・ポート D10 Direct_USB_OEn
2A AT19 FTRACE_D11 HPS 16 ビット・トレース・ポート D11 Direct_USB_RESETn
2A AU19 FTRACE_D12 HPS 16 ビット・トレース・ポート D12 Direct_USB_EMPTY
2A AT20 FTRACE_D13 HPS 16 ビット・トレース・ポート D13 Direct_USB_FULL
2A AU20 FTRACE_D14 HPS 16 ビット・トレース・ポート D14 Direct_USB_SDA
2A AU17 FTRACE_D15 HPS 16 ビット・トレース・ポート D15 Direct_USB_SCL
2A AU16 FTRACE_CLK HPS トレースクロック -
2A AP18 USB_FPGA_CLK - Blaster USB クロック
レベル 2 の表題