インテル® Quartus® Prime プロ・エディションのユーザーガイド: デザイン制約

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ID 683143
日付 10/16/2019
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ドキュメント目次
ドキュメント目次 x
1. デザインの制約 2. インターフェイス・プランニング 3. デバイスI/Oピンの管理 A. インテル® Quartus® Prime プロ・エディションユーザーガイド
1. デザインの制約 x
1.1. GUIでのデザイン制約デザインの指定 1.2. Tclスクリプトによるデザインの制約 1.3. 完全に反復的なスクリプトフロー 1.4. デザインの制約の改訂履歴
1.1. GUIでのデザイン制約デザインの指定 x
1.1.1. グローバル制約と割り当て 1.1.2. ノード、エンティティー、およびインスタンス・レベルの制約 1.1.3. インテル® Quartus® Prime GUIのコンポーネント間の調査 1.1.4. GUIでのタイミング制約の指定
1.1.2. ノード、エンティティー、およびインスタンス・レベルの制約 x
1.1.2.1. Assignment Editorでインスタンス固有の制約を指定する　 1.1.2.2. 多次元バス制約の指定　 1.1.2.3. Pin PlannerでI/O制約を指定する 1.1.2.4. Interface Plannerでのインターフェイスの制約を計画する 1.1.2.5. Chip Plannerを使用して制約を調整する　 1.1.2.6. Design Partition Plannerでのデザイン・パーティションの作成
1.2. Tclスクリプトによるデザインの制約 x
1.2.1. プロジェクトの作成と制約の適用 1.2.2. ピンの割り当て 1.2.3. Jamファイルの生成 1.2.4. Synopsys* Design Constraint (.sdc)ファイル 1.2.5. Tcl-onlyスクリプトのフロー
1.2.5. Tcl-onlyスクリプトのフロー x
1.2.5.1. Tcl-only Timing Analysis
2. インターフェイス・プランニング x
2.1. インターフェイス計画の概要　 2.2. Interface Plannerの使用 2.3. Interface Plannerユーザー・インターフェイス・コントロール 2.4. Interface Planner レポート 2.5. インターフェイス・プランニングの改訂履歴
2.2. Interface Plannerの使用 x
2.2.1. ステップ1：プロジェクトのセットアップ 2.2.2. ステップ2:Interface Plannerの初期化 2.2.3. ステップ3：プロジェクトの割り当てで計画の更新 2.2.4. ステップ4：ペリフェラル機器の配置の計画 2.2.5. ステップ5：配置データを報告する 2.2.6. ステップ6：計画の制約の検証とエクスポート　
2.2.4. ステップ4：ペリフェラル機器の配置の計画 x
2.2.4.1. クロック・ネットワークの計画 2.2.4.2. フロアプランの保存と読み込み
2.3. Interface Plannerユーザー・インターフェイス・コントロール x
2.3.1. フロー制御 2.3.2. Homeタブのコントロール 2.3.3. Assignmentsタブのコントロール 2.3.4. Planタブのコントロール 2.3.5. Reportsタブのコントロール
2.4. Interface Planner レポート x
2.4.1. レポートおよびサマリー 2.4.2. Report Pins 2.4.3. Report HSSI Channels 2.4.4. Report Clocks 2.4.5. Report Periphery Locations 2.4.6. Report Cell Connectivity 2.4.7. Report Instance Assignments
3. デバイスI/Oピンの管理 x
3.1. I/Oプランニングの概要 3.2. I/Oピンの割り当て 3.3. I/Oピン割り当てのインポートとエクスポート 3.4. EPM240Gのピン・アサインメント 3.5. I/Oタイミング 3.6. ルーティングおよびタイミング遅延の表示 3.7. スクリプトAPI 3.8. デバイスI/Oピンの管理の改訂履歴
3.1. I/Oプランニングの概要 x
3.1.1. 基本的なI/O計画フロー 3.1.2. PCBデザインツールの統合 3.1.3. Intelデバイス規約　
3.2. I/Oピンの割り当て x
3.2.1. 排他的なピングループへの割り当て　 3.2.2. スルーレートとドライブ強度の割り当て　 3.2.3. 差動ピンの割り当て 3.2.4. Tclコマンドを使用したピン・アサインメントの入力　 3.2.5. HDLコードでのピン・アサインメントの入力　
3.2.3. 差動ピンの割り当て x
3.2.3.1. 差動ピンでのI/O配置ルールのオーバーライド
3.2.5. HDLコードでのピン・アサインメントの入力　 x
3.2.5.1. 低レベルI/Oプリミティブの使用
3.3. I/Oピン割り当てのインポートとエクスポート x
3.3.1. PCBツールのインポートとエクスポート　 3.3.2. 別のターゲットデバイスへの割り当ての移行　
3.4. EPM240Gのピン・アサインメント x
3.4.1. I/O割り当て検証規則 3.4.2. I/Oアサインメントの解析 3.4.3. I/O分析レポートについて
3.4.2. I/Oアサインメントの解析 x
3.4.2.1. デザインファイルを使用しない早期I/O割り当て解析 3.4.2.2. デザインファイルを使用したI/O割り当て分析 3.4.2.3. デフォルトのI/Oピン分析のオーバーライド
3.5. I/Oタイミング x
3.5.1. 高度なI/Oタイミングの実行 3.5.2. 容量性負荷によるI/Oタイミングと電力の調整
3.5.1. 高度なI/Oタイミングの実行 x
3.5.1.1. ボードの熱モデル 3.5.1.2. ボード・トレース・モデルの定義 3.5.1.3. ボード・トレース・モデルの変更　　 3.5.1.4. 近端と遠端のI/Oタイミング解析の指定 3.5.1.5. 高度なI/Oタイミング解析レポート
3.7. スクリプトAPI x
3.7.1. 生成された合成可能なネットリスト。 3.7.2. Reserve Pins 3.7.3. 場所を設定 3.7.4. 排他的I/Oグループ 3.7.5. スルーレートと電流強度
1. デザインの制約
2. インターフェイス・プランニング
3. デバイスI/Oピンの管理
A. インテル® Quartus® Prime プロ・エディションユーザーガイド

2.3.4. Planタブのコントロール

Planタブには、インターフェイス・プランのロジックを見つけて配置するのに役立つ次のコントロールが含まれています。 Plan Designをクリックして、Planタブを表示します。

インターフェイス・プランでの配置または配置解除は、生成されたInterface Planner制約スクリプトをプロジェクトに追加するまで、プロジェクトの インテル® Quartus® Primeには適用されません。

表 6.  Planタブのコントロール
コマンド 説明
配置のための正当な場所をリストします。　
Locate Node 選択したデザイン要素が階層データベースで参照されている インテル® Quartus® Prime プロ・エディションツールのリストを表示します。Design Elementsリストの特定の要素に対してLocate Nodeコマンドが無効になっている場合、その要素はデザイン内の要素として表されていないためです。
Autoplace All 配置されていないすべてのデザイン要素をインターフェイス・プランのイネーブルな位置に配置しようとします。
Autoplace Fixed イネーブルな場所が1つしかない未配置のデザイン要素をすべてインターフェイス・プランに配置しようとします。
Unplace All インターフェイス・プランに配置されたすべてのデザイン要素を配置解除します。
Right-click > Auto-place selected element 選択したデザイン要素とそのすべての子を、インターフェイス・プランのイネーブルな場所に配置しようとします。
Chip View ターゲット・デバイス・チップを表示します。ズームインしてチップの詳細を表示します。
Package View ターゲット・デバイス・パッケージを表示します。ズームインしてチップの詳細を表示します。
I/O バンク PlanタブでI/Oバンクを選択して色分けします。
Show Differential Pin Pair Connections 一対の差動ピン間の赤い接続線を表示します。パッケージビューでは、正と負のピンにそれぞれ文字pとnのラベルが付けられます。　
Show PCIe Hard IP Interface Pins PlanタブでPCIeハードIPインターフェイスピンを選択して色分けします。このコマンドにアクセスするには、Planタブのパッケージビューで右クリックし、x1 Lanes 、x2 Lanes、x4 Lanes、x8 Lanes 、または16 Lanesを選択します。イネーブルにした後、 Color Legendで色分けを表示します。
Show DQ/DQS Pins PlanタブでPCIeハードIPインターフェイスピンを選択して色分けします。このコマンドにアクセスするには、Planタブのパッケージビューで右クリックし、x1 Lanes 、x2 Lanes、x4 Lanes、x8 Lanes 、または16 Lanesを選択します。イネーブルにした後、 Color Legendで色分けを表示します。
Right-click > Report Placeability of Selected Element Reportsタブに詳細情報を表示し、選択したセルのインターフェイス・プラン内のイネーブルな場所をフィッティングに適している順に表示します。
Copy Current View 現在のインターフェイス・プランをクリップボードにコピーして、ワードプロセッサやプレゼンテーションファイルなどの他のファイルに貼り付けます。
Reset Plan 配置されたすべてのデザイン要素を配置解除し、適用されたプロジェクト割り当てをインターフェイス・プランから削除します。すべてのプロジェクトの割り当てをイネーブルな状態にリセットします。その後、デザイン要素を配置する前にUpdate Planを実行する必要があります。このコマンドはインターフェイス・プランにのみ適用され、Interface Plannerスクリプトを適用するまで インテル® Quartus® Primeプロジェクトの割り当てには影響しません。
Load Floorplan Interface Planner Floorplan Format（.plan）ファイルを選択してロードできます。Save Floorplanをクリックして、Interface Plannerフロアプラン・ファイルを形式で保存できます。
Save Floorplan Interface Plannerフロアプランを.planファイルとして保存できます。
Undo/Redoボタン Undoボタンは、Planタブで行った最後の変更を元に戻します。Redoは最後の取り消しを再実装します。これらのコマンドを使用して、プランを変更しても前後にステップします。
図 18. 差動ピンペアのカラー・コーディング
レベル 2 の表題