F-Tile Serial Lite IV Intel® FPGA IPユーザーガイド

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ID 683074
日付 9/26/2022
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ドキュメント目次
ドキュメント目次 x
1. F-tile Serial Lite IV Intel® FPGA IPユーザーガイドについて 2. F-tile Serial Lite IV Intel® FPGA IPの概要 3. はじめに 4. 機能の説明 5. パラメーター 6. F-tile Serial Lite IV Intel® FPGA IPのインターフェイス信号 7. F-tile Serial Lite IV Intel® FPGA IPを使用したデザイン 8. F-tile Serial Lite IVユーザーガイド・アーカイブ 9. F-tile Serial Lite IV Intel® FPGA IPユーザーガイドの改訂履歴
2. F-tile Serial Lite IV Intel® FPGA IPの概要 x
2.1. リリース情報 2.2. サポートされる機能 2.3. IPバージョンのサポートレベル 2.4. デバイスのスピードグレードのサポート 2.5. リソース使用率およびレイテンシー 2.6. 帯域幅効率
3. はじめに x
3.1. インテルFPGA IPコアのインストールとライセンス取得 3.2. IPのパラメーターとオプションの指定 3.3. 生成ファイルの構造 3.4. Intel® FPGA IPコアのシミュレーション 3.5. その他のEDAツールでのIPコアの合成 3.6. フルデザインのコンパイル
3.1. インテルFPGA IPコアのインストールとライセンス取得 x
3.1.1. Intel® FPGA IP Evaluation Mode
3.4. Intel® FPGA IPコアのシミュレーション x
3.4.1. デザインのシミュレーションと検証
4. 機能の説明 x
4.1. TXデータパス 4.2. RXデータパス 4.3. F-tile Serial Lite IV Intel® FPGA IPのクロック・アーキテクチャー 4.4. リセットおよびリンクの初期化 4.5. リンクレートおよび帯域幅効率の計算
4.1. TXデータパス x
4.1.1. TX MACアダプター 4.1.2. コントロール・ワード (CW) の挿入 4.1.3. TX CRC 4.1.4. TX MIIエンコーダー 4.1.5. TX PCSおよびPMA
4.1.2. コントロール・ワード (CW) の挿入 x
4.1.2.1. バースト開始CW 4.1.2.2. バースト終了CW 4.1.2.3. アライメント・ペアCW 4.1.2.4. 空サイクルCW 4.1.2.5. IDLE CW 4.1.2.6. データワード
4.2. RXデータパス x
4.2.1. RX PCSおよびPMA 4.2.2. RX MIIデコーダー 4.2.3. RX CRC 4.2.4. RXデスキュー 4.2.5. RX CWの削除
4.4. リセットおよびリンクの初期化 x
4.4.1. TXリセットおよび初期化のシーケンス 4.4.2. RXリセットおよび初期化のシーケンス
6. F-tile Serial Lite IV Intel® FPGA IPのインターフェイス信号 x
6.1. クロック信号 6.2. リセット信号 6.3. MAC信号 6.4. トランシーバー・リコンフィグレーション信号 6.5. PMA信号
7. F-tile Serial Lite IV Intel® FPGA IPを使用したデザイン x
7.1. リセット・ガイドライン 7.2. エラー処理ガイドライン
1. F-tile Serial Lite IV Intel® FPGA IPユーザーガイドについて
2. F-tile Serial Lite IV Intel® FPGA IPの概要
3. はじめに
4. 機能の説明
5. パラメーター
6. F-tile Serial Lite IV Intel® FPGA IPのインターフェイス信号
7. F-tile Serial Lite IV Intel® FPGA IPを使用したデザイン
8. F-tile Serial Lite IVユーザーガイド・アーカイブ
9. F-tile Serial Lite IV Intel® FPGA IPユーザーガイドの改訂履歴

4.2.4. RXデスキュー

RXデスキューブロックでは、各レーンのアライメント・マーカーを検出し、データを再アライメントした後に、そのデータをRX CW削除ブロックに送信します。

アライメント・エラーが発生した場合に、IPコアによって各レーンのデータを自動アライメントできるように選択できます。これを行うには、Enable Auto AlignmentパラメーターをIPパラメーター・エディターで設定します。自動アライメント機能をディスエーブルすると、IPコアは rx_error 信号をアサートしてアライメント・エラーを示します。レーン・アライメント・エラーが発生した場合は、rx_link_reinit をアサートして、レーン・アライメント・プロセスを開始してください。

RXデスキューでは、ステートマシンに基づいてアライメント・マーカーを検出します。次の図に示すのは、RXデスキューブロックのステートです。
図 18. RXデスキューのレーン・アライメント・ステートマシンのフローチャート (自動アライメントがイネーブルになっている場合)
図 19. RXデスキューのレーン・アライメント・ステートマシンのフローチャート (自動アライメントがディスエーブルになっている場合)
  1. アライメント・プロセスはIDLEステートで始まります。すべてのPCSレーンの準備が整い、rx_link_reinit がデアサートされると、ブロックはWAITステートに移行します。
  2. WAITステートの場合、ブロックでは、検出されたすべてのマーカーが同じサイクル内でアサートされていることを確認します。この条件が真の場合、ブロックはALIGNEDステートに移行します。
  3. ブロックがALIGNEDステートの場合、レーンが調整済みであることを示します。このステートでは、ブロックはレーン・アライメントを監視し続け、すべてのマーカーが同じサイクル内に存在するかどうかを確認します。同じサイクルにマーカーが1つも存在せず、Enable Auto Alignmentパラメーターが設定されている場合、ブロックはIDLEステートになり、アライメント・プロセスを再初期化します。Enable Auto Alignmentが設定されておらず、同じサイクルにマーカーが1つも存在しない場合、ブロックはERRORステートになり、ユーザーロジックにより rx_link_reinit 信号がアサートされてレーン・アライメント・プロセスが開始するのを待ちます。
図 20. Enable Auto Alignmentがイネーブルになっているレーンの再アライメント
図 21. Enable Auto Alignmentがディスエーブルになっているレーンの再アライメント
レベル 2 の表題