インテル® Stratix® 10デバイスファミリー・ピン接続ガイドライン

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ID 683028
日付 12/23/2020
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ドキュメント目次
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インテル® Stratix® 10デバイスファミリー・ピン接続ガイドライン
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インテル® Stratix® 10 コアピン インテル® Stratix® 10高帯域幅メモリー (HBM) ピン HタイルおよびLタイルピン インテル® Stratix® 10 Eタイルピン インテル® Stratix® 10 Pタイルピン インテル® Stratix® 10ハード・プロセッサー・システム (HPS) ピン インテル® Stratix® 10デバイスの電源共有ガイドライン インテル® Stratix® 10デバイスファミリー・ピン接続ガイドラインの改訂履歴
インテル® Stratix® 10 コアピン x
クロックおよびPLLピン 専用コンフィグレーション/JTAGピン オプション/兼用コンフィグレーション・ピン 3V互換I/Oピン 3.3V I/Oピン 差動I/Oピン 外部メモリー・インターフェイス・ピン 電圧センサーピン 温度センサーピン リファレンス・ピン 接続しないピンおよび使用禁止 (DNU) ピン 電源供給ピン セキュア・デバイス・マネージャー (SDM) ピン セキュア・デバイス・マネージャー (SDM) のオプションの信号ピン インテル® Stratix® 10コアピンの注意事項
インテル® Stratix® 10高帯域幅メモリー (HBM) ピン x
UIBおよびeSRAMピン インテル® Stratix® 10 HBM電源供給ピン インテル® Stratix® 10 HBMピンの注意事項
HタイルおよびLタイルピン x
HタイルおよびLタイルピン
インテル® Stratix® 10 Eタイルピン x
インテル® Stratix® 10 Eタイルピン インテル® Stratix® 10 Eタイルピンの注意事項
インテル® Stratix® 10 Pタイルピン x
インテル® Stratix® 10 Pタイル電源供給ピン インテル® Stratix® 10 Pタイル・トランシーバー・ピン
インテル® Stratix® 10ハード・プロセッサー・システム (HPS) ピン x
HPS供給ピン HPSオシレーター・クロック入力ピン HPS JTAGピン HPS GPIOピン HPS SDMMCピン HPS NANDピン HPS USBピン HPS EMACピン HPS I2C_EMACおよびMDIOピン HPS I2Cピン HPS SPIピン HPS UARTピン HPS Traceピン インテル® Stratix® 10 HPSピンの注意事項
インテル® Stratix® 10デバイスの電源共有ガイドライン x
例1: インテル® Stratix® 10 GX 例2: インテル® Stratix® 10 GX 例3: インテル® Stratix® 10 GX (HF35パッケージのみ) 例4: インテル® Stratix® 10 GX (HF35パッケージのみ) 例5: インテル® Stratix® 10 SX (–1V、–2V、および –3V部品) 例6: インテル® Stratix® 10 SX (–2Lおよび –3X部品) 例7: インテル® Stratix® 10 SX (–1V、–2V、および –3V部品) 例8: インテル® Stratix® 10 SX (–2Lおよび –3X部品) 例9: インテル® Stratix® 10 SX (–1V、–2V、および –3V部品) (HF35パッケージのみ) 例10: インテル® Stratix® 10 SX (–2Lおよび –3X部品) (HF35パッケージのみ) 例11: インテル® Stratix® 10 SX (–1V、–2V、および –3V部品) (HF35パッケージのみ) 例12: インテル® Stratix® 10 SX (–2Lおよび –3X部品) (HF35パッケージのみ) 例13: インテル® Stratix® 10 MX (–1V、–2V、および –3V部品) 例14: インテル® Stratix® 10 MX (–1V、–2V、および –3V部品) 例15: インテル® Stratix® 10 MX (Eタイル) 例16: インテル® Stratix® 10 TX (–1V、–2V、および –3V部品) 例17: インテル® Stratix® 10 TX (–2Lおよび –3X部品) 例18: インテル® Stratix® 10 DX (–1V、–2V、および –3V部品) 例19: インテル® Stratix® 10 GX 10M 例20: インテル® Stratix® 10 GX 10M
インテル® Stratix® 10デバイスファミリー・ピン接続ガイドライン

専用コンフィグレーション/JTAGピン

注: インテルでは、 インテル® Quartus® Primeデザインを作成し、デバイスのI/Oアサインメントを入力し、デザインをコンパイルすることをお勧めしています。 インテル® Quartus® Prime開発ソフトウェアでは、I/Oアサインメントと配置のルールに従ってピン接続をチェックします。そのルールはデバイスごとに異なり、デバイスの集積度、パッケージ、I/Oアサインメント、電圧アサインメントのほか、本文書またはデバイス・ハンドブックに完全には記載されていない要因に基づきます。
表 2.  専用コンフィグレーション/JTAGピン
ピン名 ( インテル® Stratix® 10デバイス) ピン名 ( インテル® Stratix® 10 GX 10Mデバイス) ピンの機能 ピンの説明 接続ガイドライン
TCK F[1,2]_TCK 入力

専用JTAGテストクロック入力ピンです。このピンは、SDMおよびHPS JTAGチェーンへのアクセスにも使用できます。詳細については、HPS JTAGピン を参照してください。

このピンは、1kΩのプルダウン抵抗を介してGNDに接続します。

このピンは25kΩの内部プルダウンを備えています。

VCCIO_SDM電源より高い電圧をTCKピンに対して駆動しないでください。TCK入力ピンの電力供給元はVCCIO_SDM電源です。
TMS F[1,2]_TMS 入力

専用JTAGテストモード選択入力ピンです。このピンは、SDMおよびHPS JTAGチェーンへのアクセスにも使用できます。詳細については、HPS JTAGピン を参照してください。

このピンをVCCIO_SDM電源への1kΩから10kΩのプルアップ抵抗に接続してください。JTAGインターフェイスを使用しない場合は、TMSピンは、1kΩの抵抗を使用してVCCIO_SDM電源に接続してください。

このピンは25kΩの内部プルアップ抵抗を備えています。

VCCIO_SDM電源より高い電圧をTMSピンに対して駆動しないでください。TMS入力ピンの電力供給元はVCCIO_SDM電源です。
TDO F[1,2]_TDO 出力

専用JTAGテストデータ出力ピンです。このピンは、SDMおよびHPS JTAGチェーンへのアクセスにも使用できます。詳細については、HPS JTAGピン を参照してください。

JTAGインターフェイスを使用しない場合は、TDOピンは未接続のままにします。
TDI F[1,2]_TDI 入力

専用JTAGテストデータ入力ピンです。このピンは、SDMおよびHPS JTAGチェーンへのアクセスにも使用できます。詳細については、HPS JTAGピン を参照してください。

このピンをVCCIO_SDM電源への1kΩから10kΩのプルアップ抵抗に接続してください。JTAGインターフェイスを使用しない場合、TDIピンは、1kΩの抵抗を使用してVCCIO_SDM電源に接続してください。

このピンは25kΩの内部プルアップ抵抗を備えています。

VCCIO_SDM電源より高い電圧をTDIピンに対して駆動しないでください。TDI入力ピンの電力供給元はVCCIO_SDM電源です。
nSTATUS F[1,2]_nSTATUS 出力 このピンは、nCONFIGを駆動するホストとの同期およびエラーレポートに使用されます。

Avalon-STコンフィグレーション・スキームを使用している場合は、このピンは、コンフィグレーション・ホストに接続します。

その他のコンフィグレーション・スキームでは、このピンを使用してコンフィグレーション・ステータスをモニタリングすることができます。

このピンは、すべてのコンフィグレーション・スキームで、10kΩの抵抗を介してVCCIO_SDMに引き上げる必要があります。このピンは25kΩの内部プルアップ抵抗を備えています。
nCONFIG F[1,2]_nCONFIG 入力 nCONFIGピンは、デバイスをクリアしてリコンフィグレーションの準備をするために使用されます。

Avalon-STコンフィグレーション・スキームを使用している場合は、このピンは、コンフィグレーション・ホストに接続します。

その他のコンフィグレーション・スキームを使用する場合は、このピンは、10KΩの外部プルアップ抵抗を介してVCCIO_SDMに引き上げます。このピンを使用して、コンフィグレーションを再開することができます。それには、Lowに駆動してから再びHighに駆動します。 インテル® Stratix® 10コンフィグレーション・ユーザーガイド および インテル® Stratix® 10デバイスのデザイン・ガイドライン で規定されているnCONFIG動作のすべての要件に必ず従ってください。

OSC_CLK_1 F[1,2]_OSC_CLK_1 入力 このピンは、デバイス・コンフィグレーションおよびトランシーバーのキャリブレーション用のクロックとして使用されます。

トランシーバーを使用している場合は、このピンに外部クロックソースを供給してください。

外部クロックソースを使用してコンフィグレーションを行う場合や、デザイン内のトランシーバーをインスタンス化する場合は、25MHz、100MHz、または125MHzのフリーランニングのクロックソースをこのピンに供給し、デザインのコンパイル時に インテル® Quartus® Prime開発ソフトウェアでそのピンをイネーブルしてください。内部オシレーターをコンフィグレーションに使用していて、デザイン内のトランシーバーをインスタンス化しない場合は、このピンを未接続のままにしてください。

関連情報
レベル 2 の表題