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4.1. データパスの説明
送信方向で、MACではクライアント・フレームを受け入れ、パケット間ギャップ (IPG)、プリアンブル、開始フレーム識別子 (SFD)、パディング、およびCRCビットを挿入してからPHYに渡します。MACをコンフィグレーションして、追加の受け入れをクライアント・フレームで行うようにすることができます。MACではまた、TX統計カウンターを更新します。PHYではMACフレームをエンコードします。これは、リモートエンドへの信頼性の高い伝送をメディア上で行うために必要です。
受信方向で、PHYではフレームをMACに渡します。MACでは、フレームをPHYから受け取り、チェックを実行し、統計カウンターを更新し、CRC、プリアンブル、およびSFDを取り除き、フレームの残りをクライアントに渡します。RXプリアンブル・パススルー・モードでは、MACではプリアンブルとSFDを取り除くのではなく、クライアントに渡します。MACをコンフィグレーションして、完全なRXフレームがクライアント・インターフェイスで提供されるようにすることができます。フレームはCRCバイトが削除されたものか、またはCRCおよびRX PADバイトが削除されたものです。
Fタイル・イーサネット・インテル® FPGAハードIPではまた、PCS Only、FlexE、およびOTNのバリエーションもサポートしています。PCS Onlyのバリエーションでは、MIIインターフェイスをクライアントに提供し、ハードIPに実装された10Gbps、25Gbps、および400GbpsイーサネットPHYを介してイーサネット・パケットの送受信を行います。FlexEおよびOTNのバリエーションでは、PCS66インターフェイスを使用して66bブロックを送受信します。このとき、MACはバイパスします。
このIPコアでは、および400GbpsのイーサネットPHYを介して、クライアント・ロジックとイーサネット・ネットワーク間のフレームカプセル化とデータフローを処理します。このとき使用する10Gbps、25Gbps、40Gbps、50Gbps、100Gbps、200Gbps、および400GbpsイーサネットPHYは、ハードIPに実装されています。オプションでさまざまな順方向誤り訂正 (FEC) を使用します。