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  • ブランド名: Core i7

  • 製品番号: i7-12700KF

  • オーダーコード: CM8071504553829

  • スペックコード: SRL4P

  • 開発コード名: Alder Lake

Cyclone® IV EP4CGX15 FPGA

仕様

オーダーとコンプライアンス情報

オーダー & スペック情報

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14I7

  • MM# 967171
  • スペックコード SR606
  • オーダーコード EP4CGX15BF14I7
  • ステッピング A1
  • MDDS コンテンツ ID 700604

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C8

  • MM# 967334
  • スペックコード SR64Z
  • オーダーコード EP4CGX15BF14C8
  • ステッピング A1
  • MDDS コンテンツ ID 699900

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C6N

  • MM# 970237
  • スペックコード SR8JD
  • オーダーコード EP4CGX15BF14C6N
  • ステッピング A1
  • MDDS コンテンツ ID 696796,  746342

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C7

  • MM# 971178
  • スペックコード SR9DM
  • オーダーコード EP4CGX15BF14C7
  • ステッピング A1
  • MDDS コンテンツ ID 701814

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14I7N

  • MM# 971179
  • スペックコード SR9DN
  • オーダーコード EP4CGX15BF14I7N
  • ステッピング A1
  • MDDS コンテンツ ID 693136,  744685

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C6

  • MM# 971927
  • スペックコード SRAHQ
  • オーダーコード EP4CGX15BF14C6
  • ステッピング A1
  • MDDS コンテンツ ID 695976

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C7N

  • MM# 971928
  • スペックコード SRAHR
  • オーダーコード EP4CGX15BF14C7N
  • ステッピング A1
  • MDDS コンテンツ ID 694243,  744707

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C8N

  • MM# 971929
  • スペックコード SRAHS
  • オーダーコード EP4CGX15BF14C8N
  • ステッピング A1
  • MDDS コンテンツ ID 697455,  745693

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14A7N

  • MM# 974438
  • スペックコード SRCH3
  • オーダーコード EP4CGX15BF14A7N
  • ステッピング A1
  • MDDS コンテンツ ID 697807

トレード・コンプライアンス情報

  • ECCN EAR99
  • CCATS NA
  • US HTS 8542390001

製品仕様変更通知 (PCN) 情報

SR9DN

SR8JD

SR9DM

SRCH3

SR606

SR64Z

SRAHS

SRAHR

SRAHQ

ドライバーおよびソフトウェア

最新ドライバーとソフトウェア

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名前

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発売日

製品が初めて導入された日。

リソグラフィー

リソグラフィーとは、集積回路の製造に使われる半導体技術のことです。プロセスの微細度を表す単位はナノメートル (nm) です。この値から、半導体に組込まれている機能サイズが分かります。

ロジックエレメント (LE)

ロジックエレメント (LE) は、インテル® FPGA アーキテクチャにおけるロジックの最小単位です。コンパクトな LE は、効率的なロジックの使用と高度な機能を提供します。

ファブリックおよび I/O 位相ロックループ (PLL)

ファブリックおよび IO PLL は インテル® FPGA ファブリックのクロック・ネットワークと デバイスの IO セルに関連するクロック・ネットワークの設計と実装を簡素化するために使用されます

最大エンベデッド・メモリー

インテル® FPGA デバイスのプログラマブル・ファブリックにあるすべてのエンベデッド・メモリー・ブロックの合計容量です

デジタル信号処理 (DSP) ブロック

デジタル信号プロセシング (DSP) ブロックは サポートされるインテル® FPGA デバイスの数学的ビルディング・ブロックで さまざまなデジタル信号プロセシング機能を実装するためのハイパフォーマンス乗算器とアキュムレータを含んでいます

デジタル信号処理 (DSP) フォーマット

インテル® FPGA デバイス・ファミリーによって、DSP ブロックはハード・フローティング・ポイント、ハード固定ポイント、乗算および累積、乗算のみなどの異なる形式をサポートします

ハード・メモリー・コントローラー

ハード・メモリー・コントローラーは インテルFPGAに接続されたハイパフォーマンス外部メモリー・システムを実現するために使用されますハード・メモリー・コントローラーは、同等のソフト・メモリー・コントローラーと比較して 消費電力とFPGAリソースを節約し より高いフリークエンシーでの動作をサポートします

外部メモリー・インターフェイス (EMIF)

インテル® FPGA デバイスがサポートする外部メモリー・インターフェイス・プロトコルです

最大ユーザーI/O数†

インテル® FPGA デバイスの汎用 I/O ピンの最大ナンバー (利用可能な最大パッケージの場合) です
†パッケージにより 実際のカウントはこれより少なくなる場合があります

I/O 標準サポート

インテル® FPGA デバイスがサポートする汎用 I/O インターフェイス規格です

最大 LVDS ペア

インテル® FPGA デバイスにコンフィギュレーション可能な LVDS ペアの最大ナンバーで 利用可能な最大パッケージの場合パッケージタイプ別の実際のRXおよびTX LVDSペア数については デバイスのドキュメントを参照してください

最大 ノンリターン・ツー・ゼロ (NRZ) トランシーバー†

インテル® FPGA デバイスに搭載される NRZ トランシーバーの最大ナンバー (利用可能な最大パッケージの場合)
†パッケージにより 実際のカウントはこれより少なくなる場合があります

最大 ノンリターン・ツー・ゼロ (NRZ) データ・レート†

NRZトランシーバーがサポートする最大NRZデータレート
†実際のデータレートは トランシーバーのスピード・グレードによって低くなる可能性があります

トランシーバー・プロトコル・ハード IP

高速シリアル・トランシーバをサポートするために インテルFPGAデバイスで利用可能なハード知的財産トランシーバ・プロトコルのハードIPは 同等のソフトIPと比較して消費電力とFPGAリソースを節約し シリアル・プロトコルの実装を簡素化することができます

FPGA ビットストリーム・セキュリティー

インテル® FPGA デバイスファミリーによって、顧客のビットストリームのコピーを防止したり、動作中のデバイスへの不正操作を検出したりするさまざまなセキュリティー機能を使用することが可能です。

アナログ・デジタル・コンバーター

アナログ・デジタル・コンバーターは、インテル® FPGA デバイスファミリーで利用できるデータ・コンバーター・リソースです。

パッケージオプション

インテルFPGAデバイスは お客様のシステム要件に合わせて 異なるパッケージサイズ 異なるIOおよびトランシーバー数で提供されています

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製品の特性や機能の公式の定義については、データシートを参照してください。

‡ この機能は、コンピューティング・システムによっては利用できないことがあります。ご利用のシステムにこの機能が搭載されているかどうか、あるいは機能の互換性に関してシステム仕様 (マザーボード、プロセッサー、チップセット、電源、HDD、グラフィックス・コントローラー、メモリー、BIOS、ドライバー、仮想マシンモニター - VMM、プラットフォーム・ソフトウェア、およびオペレーティング・システム) を参照するには、システムベンダーにご確認ください。機能、パフォーマンス、この機能のその他の利点は、システム構成により異なります。

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