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GND P24 GND P27 GND P30 GND P33 GND N12 GND N14 GND N16 GND N18 GND N20 GND N22 GND M2 GND M5 GND M8 GND M11 GND M15 GND M17 GND M19 GND M21 GND L12 GND L15 GND L18 GND L21 GND L24 GND L27 GND L30 GND L33 GND J2 GND J5 GND J8 GND H9 GND H12 GND H15 GND H18 GND H21 GND H24 GND H27 GND H30 GND H33 GND F2 GND F5 GND E6 GND E9 GND E12 GND E15 GND E18 GND E21 GND E24 GND E27 GND E30 GND E33 GND C2 GND B3 GND B6 GND B9 GND B12 GND B15 GND B18 GND B21 GND B24 GND B27 GND B30 VCCL U17 VCCL AB14 VCCL AB22 VCCL AA13 VCCL AA15 VCCL AA17 VCCL AA19 VCCL AA21 VCCL Y14 VCCL Y16 VCCL Y18 VCCL Y20 VCCL W15 VCCL W17 VCCL W19 VCCL W21 VCCL V14 VCCL V16 VCCL V18 VCCL V20 VCCL U15 VCCL U19 VCCL U21 VCCL T14 VCCL T16 VCCL T18 VCCL T20 VCCL R15 VCCL R17 VCCL R19 VCCL R21 VCCL P14 VCCL P16 VCCL P18 VCCL P20 VCCL P22 VCCL N13 VCCL N21 VCC N19 VCC AB16 VCC AB18 VCC AB20 VCC Y22 VCC W13 VCC V22 VCC U13 VCC T22 VCC R13 VCC N15 VCC N17 VCCPT J27 VCCPT AG27 VCCPT AG7 VCCPT H8 DNU U18 VCCPGM AD24 VCCPGM AD10 TEMPDIODEn D4 TEMPDIODEp E5 VCC_CLKIN3C AG18 VCC_CLKIN4C AE17 VCC_CLKIN7C H17 VCC_CLKIN8C K18 VCCA_PLL_B1 AH18 VCCA_PLL_B2 AH17 VCCA_PLL_L2 U28 VCCA_PLL_L3 V28 VCCA_PLL_R2 U7 VCCA_PLL_R3 V7 VCCA_PLL_T1 G18 VCCA_PLL_T2 G17 VCCD_PLL_B1 AF18 VCCD_PLL_B2 AF17 VCCD_PLL_L2 U26 VCCD_PLL_L3 V26 VCCD_PLL_R2 U9 VCCD_PLL_R3 V9 VCCD_PLL_T1 J18 VCCD_PLL_T2 J17 VCCIO1A B34 VCCIO1A N28 VCCIO1A L26 VCCIO1A H29 VCCIO1A G32 VCCIO1C M32 VCCIO1C V30 VCCIO1C U34 VCCIO1C T31 VCCIO2A AB28 VCCIO2A AN34 VCCIO2A AH32 VCCIO2A AG28 VCCIO2A AD25 VCCIO2C W25 VCCIO2C AD32 VCCIO2C W29 VCCIO2C W32 VCCIO3A AF25 VCCIO3A AM27 VCCIO3A AL30 VCCIO3A AJ25 VCCIO3B AF22 VCCIO3B AM25 VCCIO3C AH21 VCCIO3C AM20 VCCIO3C AJ18 VCCIO4A AF12 VCCIO4A AM3 VCCIO4A AL6 VCCIO4A AH10 VCCIO4B AH13 VCCIO4B AM10 VCCIO4C AG16 VCCIO4C AP17 VCCIO4C AM13 VCCIO5A AD9 VCCIO5A AN1 VCCIO5A AH3 VCCIO5A AG6 VCCIO5A AB7 VCCIO5C W4 VCCIO5C AC3 VCCIO5C V1 VCCIO5C U5 VCCIO6A H7 VCCIO6A N7 VCCIO6A L10 VCCIO6A G3 VCCIO6A B1 VCCIO6C T10 VCCIO6C T3 VCCIO6C T6 VCCIO6C L3 VCCIO7A F10 VCCIO7A J10 VCCIO7A D5 VCCIO7A C8 VCCIO7B C10 VCCIO7B J13 VCCIO7C C13 VCCIO7C G14 VCCIO7C F17 VCCIO8A C32 VCCIO8A J23 VCCIO8A G25 VCCIO8A D29 VCCIO8B C25 VCCIO8B G22 VCCIO8C A18 VCCIO8C H19 VCCIO8C C22 VCCPD1A N23 VCCPD1C R23 VCCPD2A AA23 VCCPD2C W23 VCCPD3A AC23 VCCPD3B AC21 VCCPD3C AC19 VCCPD4A AC13 VCCPD4B AC15 VCCPD4C AC17 VCCPD5A AB12 VCCPD5C Y12 VCCPD6A P12 VCCPD6C T12 VCCPD7A M12 VCCPD7B M14 VCCPD7C M16 VCCPD8A M22 VCCPD8B M20 VCCPD8C M18 1A VREFB1AN0 VREFB1AN0 VREFB1AN0 J26 1C VREFB1CN0 VREFB1CN0 VREFB1CN0 P26 2A VREFB2AN0 VREFB2AN0 VREFB2AN0 AA26 2C VREFB2CN0 VREFB2CN0 VREFB2CN0 V27 3A VREFB3AN0 VREFB3AN0 VREFB3AN0 AG25 3B VREFB3BN0 VREFB3BN0 VREFB3BN0 AG22 3C VREFB3CN0 VREFB3CN0 VREFB3CN0 AH20 4A VREFB4AN0 VREFB4AN0 VREFB4AN0 AG10 4B VREFB4BN0 VREFB4BN0 VREFB4BN0 AG13 4C VREFB4CN0 VREFB4CN0 VREFB4CN0 AH16 5A VREFB5AN0 VREFB5AN0 VREFB5AN0 AF7 5C VREFB5CN0 VREFB5CN0 VREFB5CN0 AA9 6A VREFB6AN0 VREFB6AN0 VREFB6AN0 P9 6C VREFB6CN0 VREFB6CN0 VREFB6CN0 U8 7A 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See Stratix III device pin table for details. (2) The individual index number of the pin in this column may not be the same as its companion Stratix III device, but the functionality of the pin is fully migratable. (3) These NO CONNECT (NC) pins are MSEL configuration input pins in the Stratix III device and should be connected on the board to configure the FPGA prototype. (4) This NC pin is a VCCBAT pin in the Stratix III device and should be connected for the FPGA prototype. (5) This NC pin is a VCCPT pin in the Stratix III device and should be connected for the FPGA prototype.