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1. インテル® Stratix® 10 SEU緩和の概要
更新対象: |
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インテル® Quartus® Prime デザインスイート 18.1 |
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インテル® Quartus® Prime開発ソフトウェアで提供されている機能の中には、SEUの影響、つまりソフトエラーの検出と修正、またデザインに対するSEUの影響の特性評価を行うためのものがあります。また、一部のIntel FPGAには、エラーの検出と修正に役立つ専用の回路が含まれています。
Intel FPGAのメモリーは、ユーザーロジック(ブロックメモリーとレジスター)およびConfiguration Random Access Memory (CRAM) 内にあります。 インテル® Quartus® Prime ProgrammerではCRAMのロードには .sof ファイルが使用されます。その後CRAMでは、すべてのFPGAロジックと配線のコンフィグレーションが行われます。SEUでCRAMビットを検出した場合、デバイスでCRAMビットを使用していなければその影響は無害ですが、影響が深刻になる可能性があるのは、SEUによって重要なロジックまたは内部信号配線が影響を受けた場合です。
多くの場合、デザインでSEUが発生する可能性は低いので緩和は必要ありませんが、複数の高密度コンポーネントを含むシステムなどの非常に複雑なシステムでは、エラー率が重要なシステムデザインの要素になる可能性があります。システムに複数のFPGAが含まれていて、非常に高い信頼性と可用性が必要な場合は、ソフトエラーの影響を考慮し、この章で説明する手法で、このような種類のエラーを検出して修復してください。