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Pattern Matching Performance with HyperScan* Software: Brief

Solution Brief: Discusses pattern matching performance optimization of Sensory Networks HyperScan* software with Intel® Xeon® processors.

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Software Optimization for Intel® Multi-Core Technology

Intel® microarchitecture code name Nehalem with Intel® multi-core technology is ideal for cryptography, transcoding, and intrusion detection.

インテル® Xeon® プロセッサー 5600/5500 ファミリーと、インテル® 5520 チップセット

組込み機器向けインテル® Xeon® 5600 プロセッサー・ファミリーとインテル® 5520 チップセットは、通信機器に最適な性能と I/O 機能を提供します。

Intel® I/O Controller Hub 10: Spec Update

Specification Update: Contains Intel® I/O Controller Hub 10 family errata, specification and document changes, and clarifications. (v.018, Dec. 2013)

Uncore Performance Monitoring Registers and Counters

Showcases Intel® microarchitecture uncore performance monitoring registers, counters, and integrated memory controller specifics.

Intel® ICH Family SPI Flash Programming Guide: Application Note

Application Note: Clarify aspects of programming SPI flash on ICH family-based platforms, includes compatibility, BIOS, and tools.(v.2.4, Sept. 2008)

インテル® Xeon® プロセッサー 5600/5500 番台:ブロック図

インテル® Xeon® プロセッサー 5600 / 5500 番台のインタラクティブ・ブロック図に、機能と接続性を示します。

Intel® Atom™ Processor Optimized for Real-Time Control

White Paper: Guidelines for implementing programmable logic controllers using Intel® technology that supports real-time control. (v.1, Jan. 2010)

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Data Plane Packet Processing Embedded Intel® Architecture: Paper

White Paper: Discusses techniques for overcoming challenges to achieve high-performance data plane packet processing on embedded Intel® architecture.

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The Right Computing Platform for Real-World Testing: Brief

Solution Brief: Test solutions based on Intel® multi-core processors support dynamic, two-way traffic and thoroughly test computing infrastructure.

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